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AD9512 参数 Datasheet PDF下载

AD9512图片预览
型号: AD9512
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内容描述: 1.2 GHz的时钟分配IC , 1.6 GHz的输入,分频器,延迟调整,五路输出 [1.2 GHz Clock Distribution IC, 1.6 GHz Inputs, Dividers, Delay Adjust, Five Outputs]
分类和应用: 时钟
文件页数/大小: 48 页 / 1007 K
品牌: ABCO [ ABCO ELECTRONICS CO.LTD ]
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AD9512
时钟输出添加剂时间抖动
表5 。
参数
LVPECL输出添加剂时间抖动
CLK1 = 622.08兆赫
任何LVPECL ( OUT0至OUT2 ) = 622.08兆赫
分频比= 1
CLK1 = 622.08兆赫
任何LVPECL ( OUT0至OUT2 ) = 155.52兆赫
分频比÷ 4
CLK1 = 400 MHz的
任何LVPECL ( OUT0至OUT2 ) = 100兆赫
分频比÷ 4
CLK1 = 400 MHz的
任何LVPECL ( OUT0至OUT2 ) = 100兆赫
分频比÷ 4
其他LVPECL = 100 MHz的
两者的LVDS ( OUT3 , OUT4 )= 100兆赫
CLK1 = 400 MHz的
任何LVPECL ( OUT0至OUT2 ) = 100兆赫
分频比÷ 4
其他LVPECL = 50 MHz的
这两个LVDS ( OUT3 , OUT4 )= 50 MHz的
CLK1 = 400 MHz的
任何LVPECL ( OUT0至OUT2 ) = 100兆赫
分频比÷ 4
其他LVPECL = 50 MHz的
这两个CMOS ( OUT3 , OUT4 )= 50 MHz的( B输出关闭)
CLK1 = 400 MHz的
任何LVPECL ( OUT0至OUT2 ) = 100兆赫
分频比÷ 4
其他LVPECL = 50 MHz的
这两个CMOS ( OUT3 , OUT4 )= 50 MHz的(B点输出)
LVDS输出添加剂时间抖动
CLK1 = 400 MHz的
LVDS( OUT3 )= 100兆赫
分频比÷ 4
CLK1 = 400 MHz的
LVDS( OUT4 )= 100兆赫
分频比÷ 4
CLK1 = 400 MHz的
LVDS( OUT3 )= 100兆赫
分频比÷ 4
LVDS ( OUT4 )= 50 MHz的
所有LVPECL = 50 MHz的
典型值
40
最大
单位
飞秒均方根
测试条件/评论
BW = 12千赫 - 20兆赫( OC- 12 )
55
飞秒均方根
BW = 12千赫 - 20兆赫( OC- 3 )
215
飞秒均方根
从ADC方法的信噪比计算;
F
C
= 100 MHz的一个
IN
= 170兆赫
215
飞秒均方根
从ADC方法的信噪比计算;
F
C
= 100 MHz的一个
IN
= 170兆赫
222
飞秒均方根
干扰源(S )
干扰源(S )
从ADC方法的信噪比计算;
F
C
= 100 MHz的一个
IN
= 170兆赫
225
飞秒均方根
干扰源(S )
干扰源(S )
从ADC方法的信噪比计算;
F
C
= 100 MHz的一个
IN
= 170兆赫
225
飞秒均方根
干扰源(S )
干扰源(S )
从ADC方法的信噪比计算;
F
C
= 100 MHz的一个
IN
= 170兆赫
干扰源(S )
干扰源(S )
264
飞秒均方根
从ADC方法的信噪比计算;
F
C
= 100 MHz的一个
IN
= 170兆赫
319
飞秒均方根
从ADC方法的信噪比计算;
F
C
= 100 MHz的一个
IN
= 170兆赫
395
飞秒均方根
从ADC方法的信噪比计算;
F
C
= 100 MHz的一个
IN
= 170兆赫
干扰源(S )
干扰源(S )
版本A |第10页48