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1斯里ES FP GA s
富nctio最终钛英里纳克牛逼的EST
逻辑模块内部延迟AC时间确定
经过布局布线。该DirectTime分析工具
显示实际的时序参数电路的延迟。 ACT 1
设备是交流测试，以一个“像素合并”电路规格。
该电路包括一个输入缓冲器+ N逻辑模块+
一个输出缓冲（N =为A1010B 16 ; N = 28 A1020B ） 。该
逻辑模块被沿着所述装置的两侧分布，如
反相或非反相缓冲器。该模块是
通过编程反熔丝具有典型的连接
容性负载。
传播延迟[T
PD
= (t
PLH
+ t
PHL
）/ 2]进行测试的
下面AC测试规范。
Outpu T缓冲P呃formance D E慧慧纳克（ 5V ）
SINK
12
–4
来源
10
I
OH
（MA ）
0.3
0.4
V
OL
（伏）
0.5
0.6
I
OL
（MA ）
–6
8
–8
6
–10
4
0.2
–12
4.0
3.6
3.2
2.8
2.4
2.0
V
OH
（伏）
军事，最坏情况下的值，在125°C ， 4.5 V.
商业，最坏情况下，在70℃ ， 4.75 V.
注意：
上面的曲线是基于样本设备的刻画，并且不是在所有的设备完全测试。
Outpu T缓冲P呃formance D E慧慧纳克（ 3 3V ）
SINK
12
–4
来源
10
I
OH
（MA ）
0.1
0.2
V
OL
（伏）
0.3
0.4
I
OL
（MA ）
–6
8
–8
6
–10
4
0.0
–12
0
0.5
1.0
1.5
2.0
2.5
V
OH
（伏）
商业，最坏情况下，在70℃ ， 4.75 V.
注意：
上面的曲线是基于样本设备的刻画，并且不是在所有的设备完全测试。
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ACTEL [ Actel Corporation ]
