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APA300-FGG1152ES 参数 Datasheet PDF下载

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型号: APA300-FGG1152ES
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内容描述: 的ProASIC闪存系列FPGA [ProASIC Flash Family FPGAs]
分类和应用: 闪存
文件页数/大小: 178 页 / 5078 K
品牌: ACTEL [ Actel Corporation ]
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v5.9
的ProASIC
加™
闪存系列FPGA
高性能路由层次
超快速的本地和长途线网络
高速超长线网络
高性能,低偏移,分割的全球网络
100%的可路由与利用
®
特点和优点
大容量
商业和工业
75,000至1万个系统门
双端口SRAM的27 K至198千比特
66至712的用户I / O的
300万到100万系统门
双端口SRAM的72 K至198千比特
158到712用户I / O
0.22微米4 LM基于闪存的CMOS工艺
上电即行(LAPU ) 0级支持
单芯片解决方案
没有配置设备所需
保持在掉电/上循环编程设计
军用/航空器件工作在整个军用温度
范围
3.3 V , 32位PCI ,高达50 MHz ( 33 MHz的对军事
温度)
两个集成的PLL
外部系统的性能高达150 MHz
业内最有效的安全密钥(的FlashLock
®
)
低阻抗的Flash开关
分段分层路由结构
小型,高效,可配置(组合或时序)
逻辑单元
APA075
75,000
3,072
27 k
12
2
2
4
24
158
是的
是的
100, 144
208
144
APA150
150,000
6,144
36k
16
2
2
4
32
242
是的
是的
100
208
456
144, 256
I / O
在每个输入施密特触发器选项
2.5 V / 3.3 V的支持与个人可选择的电压
和压摆率
双向全球的I / O
符合PCI规范修订版2.2
边界扫描测试IEEE标准。 1149.1 ( JTAG )标准
引脚兼容跨越的ProASIC包
PLUS
家庭
PLL与灵活相,乘法/除法和延迟
能力
内部和/或外部动态配置PLL
两个LVPECL差分对的时钟或数据输入
灵活性与行业标准的前端工具的选择
通过前端定时和门有效的设计
优化
在系统通过JTAG端口编程(ISP )
的SmartGen网表生成确保优化使用
嵌入式存储器块
24 SRAM和FIFO配置,同步和
异步操作高达150 MHz (典型值)
军事
编程的Flash技术
独特的时钟调节电路
标准FPGA和ASIC设计流程
性能
ISP支持
安全编程
低功耗
静态存储器和FIFO
表1 -
的ProASIC
PLUS
产品廓
设备
最大的系统门
瓷砖(寄存器)
嵌入式RAM位( K = 1,024位)
嵌入式RAM块( 256x9 )
LVPECL
PLL
全球网络
最大时钟
最大用户I / O
JTAG ISP
PCI
封装(引脚数)
TQFP
PQFP
PBGA
FBGA
CQFP
2
CCGA / LGA
2
注意事项:
APA300
1
300,000
8,192
72 k
32
2
2
4
32
290
是的
是的
208
456
144, 256
208, 352
APA450
450,000
12,288
108 k
48
2
2
4
48
344
是的
是的
208
456
144, 256, 484
APA600
1
600,000
21,504
126 k
56
2
2
4
56
454
是的
是的
208
456
256, 484, 676
208, 352
624
APA750
750,000
32,768
144 k
64
2
2
4
64
562
是的
是的
208
456
676, 896
APA1000
1
1,000,000
56,320
198 k
88
2
2
4
88
712
是的
是的
208
456
896, 1152
208, 352
624
1.可作为商业/工业和军事/ MIL- STD- 883B设备。
2.这些软件包仅适用于军事/ MIL- STD- 883B设备。
D E权证M B ER 2 0 0 9
©2009 Actel公司
i
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