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    BG329 参数 Datasheet PDF下载

    BG329图片预览
    型号： BG329
    PDF下载： 下载PDF文件 查看货源
    内容描述： SX -A系列FPGA [SX-A Family FPGAs]
    分类和应用：
    文件页数/大小： 108 页 / 824 K
    品牌： ACTEL [ Actel Corporation ]
     浏览型号BG329的Datasheet PDF文件第34页浏览型号BG329的Datasheet PDF文件第35页浏览型号BG329的Datasheet PDF文件第36页浏览型号BG329的Datasheet PDF文件第37页浏览型号BG329的Datasheet PDF文件第39页浏览型号BG329的Datasheet PDF文件第40页浏览型号BG329的Datasheet PDF文件第41页浏览型号BG329的Datasheet PDF文件第42页  
    SX -A系列FPGA
    时序特性
    表2-14 •
    A54SX08A时序特性
    （最坏情况下的商业条件，V
    CCA
    = 2.25 V
    ,
    V
    CCI
    = 3.0 V，T
    J
    = 70°C)
    -2速度
    参数
    C-细胞传播延迟
    1
    t
    PD
    内置阵列模块
    0.9
    1.1
    1.2
    1.7
    ns
    描述
    速度-1
    标准。速度
    分钟。
    马克斯。
    -F速度
    分钟。马克斯。单位
    分钟。马克斯。分钟。马克斯。
    预测布线延迟
    2
    t
    DC
    t
    FC
    t
    RD1
    t
    RD2
    t
    RD3
    t
    RD4
    t
    RD8
    t
    RD12
    FO = 1路由延迟，直连
    FO = 1路由延迟，快速连接
    FO = 1路由延迟
    FO = 2路由延迟
    FO = 3路由延迟
    FO = 4路由延迟
    FO = 8路由延迟
    FO = 12路由延迟
    0.1
    0.3
    0.3
    0.5
    0.6
    0.8
    1.4
    2
    0.1
    0.3
    0.4
    0.5
    0.7
    0.9
    1.5
    2.2
    0.1
    0.4
    0.5
    0.6
    0.8
    1
    1.8
    2.6
    0.1
    0.6
    0.6
    0.8
    1.1
    1.4
    2.5
    3.6
    ns
    ns
    ns
    ns
    ns
    ns
    ns
    ns
    R-小区定时
    t
    RCO
    t
    CLR
    t
    预设
    t
    SUD
    t
    HD
    t
    WASYN
    t
    RECASYN
    t
    HASYN
    t
    MPW
    连续时钟到Q
    异步清除到Q的
    异步预置到Q
    触发器的数据输入建立
    触发器的数据输入保持
    异步脉冲宽度
    异步恢复时间
    异步保持时间
    时钟脉冲宽度
    0.7
    0.0
    1.4
    0.4
    0.3
    1.6
    0.7
    0.6
    0.7
    0.8
    0.0
    1.5
    0.4
    0.3
    1.8
    0.8
    0.6
    0.7
    0.9
    0.0
    1.8
    0.5
    0.4
    2.1
    0.9
    0.8
    0.9
    1.2
    0.0
    2.5
    0.7
    0.6
    2.9
    1.3
    1.0
    1.2
    ns
    ns
    ns
    ns
    ns
    ns
    ns
    ns
    ns
    输入模块传输延迟
    t
    INYH
    t
    INYL
    t
    INYH
    t
    INYL
    t
    INYH
    t
    INYL
    注意事项：
    1.对于双宏模块，使用吨
    PD
    + t
    RD1
    + t
    PDN
    , t
    RCO
    + t
    RD1
    + t
    PDN
    或T
    PD1
    + t
    RD1
    + t
    SUD
    ，适当的指令。
    2.路由延迟对于典型设计跨最坏情况下的运行工况。这些参数应被用于估计装置
    性能。布线后的时序分析或模拟需要确定实际性能。
    输入数据垫为Y高2.5 V LVCMOS
    输入数据垫为Y低2.5 V LVCMOS
    输入数据垫为Y高3.3 V PCI
    输入数据垫为Y低3.3 V PCI
    输入数据垫为Y高3.3 V LVTTL
    输入数据垫为Y低3.3 V LVTTL
    0.8
    1.0
    0.6
    0.7
    0.7
    1.0
    0.9
    1.2
    0.6
    0.8
    0.7
    1.1
    1.0
    1.4
    0.7
    0.9
    0.9
    1.3
    1.4
    1.9
    1.0
    1.3
    1.2
    1.8
    ns
    ns
    ns
    ns
    ns
    ns
    2 -1 8
    v5.3

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