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HCPL-0723 参数 Datasheet PDF下载

HCPL-0723图片预览
型号: HCPL-0723
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内容描述: 50 MBd的2纳秒PWD高速CMOS光电耦合器 [50 MBd 2 ns PWD High Speed CMOS Optocoupler]
分类和应用: 光电输出元件
文件页数/大小: 13 页 / 236 K
品牌: AGILENT [ AGILENT TECHNOLOGIES, LTD. ]
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脉冲宽度失真( PWD )是
T的差
PHL
t
PHL
并且往往决定了
的最大数据速率的容量
的传输系统。 PWD能
可以通过以百分数表示
通过分割该PWD (单位:ns )
最小脉冲宽度( NS )
收发。通常情况下,
PWD的20-30 %的数量级上
的最小脉冲宽度是
容忍的。
传播延迟偏斜,T
PSK
,是
一个重要的参数,以
考虑并行数据应用
系统蒸发散的地方同步
在并行数据线的信号是一
关注。如果该并行数据是
通过一组被发送
在光电耦合器,差异
传播延迟将导致
数据在输出到
光电耦合器在不同
次。如果在这个差值
传播延迟是足够大
它将确定最大
速率的并行数据可
通过光电耦合器发送。
传播延迟偏斜定义
作为之间的区别
最小和最大
传播延迟,要么吨
PLH
or
t
PHL
对于任何给定组的
光耦合器这些操作
在相同的条件下(即,
同样的驱动电流,电源
电压,输出负载,并
操作温度) 。如
在图4中所示,如果
一组光电耦合器的输入端
切换ON或OFF时
同时,叔
PSK
之间的最短差
传播延迟,要么吨
PLH
or
t
PHL
和最长的传播
延迟,要么吨
PLH
或T
PHL
.
如前所述,T
PSK
可以
确定最大并行
数据传输速率。图5
是典型的时序图
并行数据应用
两个时钟线和数据线
通过发送
光电耦合器。如图所示
在数据信号和时钟信号
输入和输出
光电耦合器。在这种情况下
数据被假定为定时关
的时钟的上升沿。
传播延迟偏斜
表示的不确定性
那里边可能是后
通过发送
光电耦合器。图5示出了
会出现在两个不确定性
数据线和时钟线。这是
重要的是这两个区域
不确定性不重叠,
否则时钟信号可能
之前的所有数据的到达
输出相继落户,或一些
数据输出可能开始
时钟信号之前改变
已经到来。从这些
考虑,绝对
最小脉冲宽度,可以是
通过在光电耦合器发送
并行应用程序是两次t
PSK
.
谨慎的设计应该使用
稍长的脉冲宽度,以
确保任何额外
在该休息的不确定性
电路不引起问题。
本HCPL - 7723 / 0723
光电耦合器提供的优势
的性能规格有保证的
传播延迟,脉冲宽度
失真和传播延迟
歪斜在推荐
温度和电源
范围。
V
I
50%
V
O
2.5 V,
CMOS
t
PSK
V
I
50%
V
O
2.5 V,
CMOS
图4.时序图来说明传播延迟歪斜, tPSK指两个器件。
数据
输入
时钟
数据
输出
时钟
t
PSK
t
PSK
图5.并行数据传输的例子。
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