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    EP1810 参数 Datasheet PDF下载

    EP1810图片预览
    型号： EP1810
    PDF下载： 下载PDF文件 查看货源
    内容描述： Altera的经典系列器件提供了一个解决方案，高速，低功率逻辑整合。制造在先进的CMOS技术 [The Altera Classic device family offers a solution to high-speed, lowpower logic integration. Fabricated on advanced CMOS technology]
    分类和应用：
    文件页数/大小： 42 页 / 643 K
    品牌： ALTERA [ ALTERA CORPORATION ]
     浏览型号EP1810的Datasheet PDF文件第1页浏览型号EP1810的Datasheet PDF文件第2页浏览型号EP1810的Datasheet PDF文件第4页浏览型号EP1810的Datasheet PDF文件第5页浏览型号EP1810的Datasheet PDF文件第6页浏览型号EP1810的Datasheet PDF文件第7页浏览型号EP1810的Datasheet PDF文件第8页浏览型号EP1810的Datasheet PDF文件第9页  
    经典EPLD系列数据手册
    f
    实用
    描述
    欲了解更多信息，请参阅
    MAX + PLUS II可编程逻辑
    开发系统&软件的数据表。
    经典架构包括以下内容：
    s
    s
    s
    s
    宏单元
    可编程寄存器
    输出使能/时钟选择
    反馈选择
    宏单元
    经典的宏单元，在显示
    图1中，
    可单独配置
    顺序和组合逻辑操作。八大产品条款
    形成一个可编程与阵列的馈
    OR
    门的组合
    逻辑实现。一个附加的乘积项被用于
    异步清零控制内部寄存器;其他产品术语
    实现任一输出使能或逻辑阵列生成的时钟。
    输入到可编程AND阵列来自于对真实和
    从I / O引脚补充的专用输入信号，反馈的
    配置为输入，并从宏单元的输出反馈。信号
    从专门的输入全局路由，可以养活所有的输入
    器宏单元。反馈控制复用器的路由
    从宏单元和I / O引脚的反馈信号。有关其他
    反馈选择CON连接gurations信息，请参阅
    图3中749页上。
    图1.经典宏蜂窝设备
    逻辑阵列
    全球
    时钟
    VCC
    输出使能/时钟选择
    OE
    CLK
    Q
    CLR
    可编程
    注册
    输入， I / O和
    MACROCELL
    反馈
    以逻辑阵列
    反馈
    SELECT
    异步清零
    Altera公司。
    747

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