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    CS5342-CZZ 参数 Datasheet PDF下载

    CS5342-CZZ图片预览
    型号： CS5342-CZZ
    PDF下载： 下载PDF文件 查看货源
    内容描述： 105分贝， 192千赫，多比特音频A / D转换器 [105 dB, 192 kHz, MULTI-BIT AUDIO A/D CONVERTER]
    分类和应用： 转换器
    文件页数/大小： 22 页 / 402 K
    品牌： CIRRUS [ CIRRUS LOGIC ]
     浏览型号CS5342-CZZ的Datasheet PDF文件第7页浏览型号CS5342-CZZ的Datasheet PDF文件第8页浏览型号CS5342-CZZ的Datasheet PDF文件第9页浏览型号CS5342-CZZ的Datasheet PDF文件第10页浏览型号CS5342-CZZ的Datasheet PDF文件第12页浏览型号CS5342-CZZ的Datasheet PDF文件第13页浏览型号CS5342-CZZ的Datasheet PDF文件第14页浏览型号CS5342-CZZ的Datasheet PDF文件第15页  
    CS5342
    开关特性 - 串行音频端口
    （逻辑"0" = GND = 0 V ;
    逻辑"1" = VL ，C
    L
    = 20 pF的）
    参数
    MCLK规格
    MCLK周期
    MCLK脉冲占空比
    主模式
    SCLK下降到LRCK
    SCLK下降沿到SDOUT有效
    SCLK占空比
    单速
    双速
    四倍速
    t
    MSLR
    t
    SDO
    -20
    -
    -
    -
    -
    -
    -
    50
    50
    33
    20
    32
    -
    -
    -
    ns
    ns
    %
    %
    %
    t
    CLKw
    26
    52
    40
    -
    -
    -
    31
    1303
    60
    ns
    ns
    %
    符号
    民
    典型值
    最大
    单位
    从模式
    单速*
    LRCK占空比
    SCLK周期
    SCLK占空比
    SDOUT有效的前SCLK上升沿
    SDOUT有效后SCLK上升沿
    SCLK下降到LRCK边缘
    双速*
    LRCK占空比
    SCLK周期（注9 ）
    SCLK占空比
    SDOUT有效的前SCLK上升沿
    SDOUT有效后SCLK上升沿
    SCLK下降到LRCK边缘
    四倍速*
    （注2 ）
    LRCK占空比
    SCLK周期（注9 ）
    SCLK占空比
    SDOUT有效的前SCLK上升沿
    SDOUT有效后SCLK上升沿
    SCLK下降到LRCK边缘
    t
    STP
    t
    HLD
    t
    SLRD
    t
    SCLKW
    40
    104
    40
    10
    5
    -8
    -
    -
    -
    -
    -
    -
    60
    -
    50
    -
    -
    8
    %
    ns
    %
    ns
    ns
    ns
    t
    STP
    t
    HLD
    t
    SLRD
    t
    SCLKW
    40
    193
    45
    10
    5
    -20
    -
    -
    -
    -
    -
    -
    60
    -
    55
    -
    -
    20
    %
    ns
    %
    ns
    ns
    ns
    t
    STP
    t
    HLD
    t
    SLRD
    t
    SCLKW
    40
    290
    45
    10
    5
    -20
    -
    -
    -
    -
    -
    -
    60
    -
    55
    -
    -
    20
    %
    ns
    %
    ns
    ns
    ns
    *对于速度模式的说明，请参阅表1第15页
    注释： 9. SCLK必须同步地从MCLK来导出和SCLK / LRCK的比值必须等于48 。
    DS608PP2
    11

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