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CY8C29466-24PVXI 参数 Datasheet PDF下载

CY8C29466-24PVXI图片预览
型号: CY8C29466-24PVXI
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内容描述: PSoC®可编程系统级芯片™ [PSoC® Programmable System-on-Chip™]
分类和应用:
文件页数/大小: 47 页 / 1490 K
品牌: CYPRESS [ CYPRESS SEMICONDUCTOR ]
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CY8C29466 , CY8C29566
CY8C29666 , CY8C29866
12.3 DC电气特性
12.3.1直流芯片级规范
下表列出了许可的最大和最小规格的电压和温度范围: 4.75V到5.25V
和-40°C
T
A
85°C ,或3.0V至3.6V和-40°C
T
A
85°C ,分别。典型参数适用于5V和3.3V ,25° C和
仅供设计参考。
表12-4 。 DC芯片级规范
符号
VDD
I
DD
I
DD3
I
DDP
I
SB
I
SBH
I
SBXTL
I
SBXTLH
V
REF
电源电压
电源电流
电源电流
当IMO = 6 MHz的使用SLIMO电源电流
模式。
休眠(模式)电流,在POR , LVD ,睡眠定时器,
WDT和内部慢速振荡器活动。
休眠(模式)电流,在POR , LVD ,睡眠定时器,
WDT和内部慢速振荡器活动。
休眠(模式)电流,在POR , LVD ,睡眠定时器,
WDT ,内部低频振荡器,以及32 kHz晶振
振荡器活动。
休眠(模式)电流,在POR , LVD ,睡眠定时器,
WDT和32 kHz晶振活跃。
参考电压(带隙)
描述
3.00
1.28
典型值
8
5
2
3
4
4
5
1.3
最大
5.25
14
9
3
10
25
12
27
1.32
单位
V
mA
mA
mA
μA
μA
μA
μA
V
笔记
SEE
条件是5.0V ,T
A
= 25
o
C, CPU = 3兆赫,
系统时钟倍频器被禁用, VC1 = 1.5 MHz时,
VC2 = 93.75 kHz时, VC3 = 0.366千赫。
条件是VDD = 3.3V ,T
A
= 25
o
C, CPU = 3兆赫,
系统时钟倍频器被禁用, VC1 = 1.5 MHz时, VC2 = 93.75
千赫, VC3 = 0.366千赫。
条件是VDD = 3.3V ,T
A
= 25
o
C, CPU = 0.75 MHz时,
系统时钟倍频器被禁用,
VC1 = 0.375兆赫, VC2 = 23.44 kHz时, VC3 = 0.09千赫。
条件与内部低速振荡器,
VDD = 3.3V , -40
o
C
T
A
55
o
C.
条件与内部低速振荡器,
VDD = 3.3V , 55
o
Ç <牛逼
A
85
o
C.
条件为,在正确加载后, 1
μW
最大,
32.768 kHz晶振。 VDD = 3.3V , -40
o
C
T
A
55
o
C.
条件为,在正确加载后, 1
μW
最大,
32.768 kHz晶振。 VDD = 3.3V , 55
o
Ç <牛逼
A
85
o
C.
修剪合适的VDD。
12.3.2直流通用I / O规格
下表列出了许可的最大和最小规格的电压和温度范围: 4.75V到5.25V
和-40°C
T
A
85°C ,或3.0V至3.6V和-40°C
T
A
85°C ,分别。典型参数适用于5V和3.3V ,25° C和
仅供设计参考。
表12-5 。直流GPIO规范
符号
R
PU
R
PD
V
OH
上拉电阻
下拉电阻
高输出电平
描述
4
4
VDD
- 1.0
典型值
5.6
5.6
最大
8
8
单位
V
I
OH
= 10 mA时, VDD = 4.75〜 5.25V (总共8个负载,
4在偶数端口引脚(例如,P0 [2]中,P1 [4]) ,
4对奇数端口引脚(例如,P0 [3]中,P1 [5] ))。
80毫安最大组合我
OH
财政预算。
I
OL
= 25 mA时, VDD = 4.75〜 5.25V (总共8个负载,
4在偶数端口引脚(例如,P0 [2]中,P1 [4]) ,
4对奇数端口引脚(例如,P0 [3]中,P1 [5] ))。
150毫安最大组合我
OL
财政预算。
V
OH
= Vdd的- 1.0V ,看到在总电流的限制
该说明的VOH
V
OL
= 0.75V ,看到的总电流中的限制
注意,对于VOL
VDD = 3.0〜 5.25 。
VDD = 3.0〜 5.25 。
格罗斯测试1
μA.
取决于封装和引脚。温度= 25
o
C.
取决于封装和引脚。温度= 25
o
C.
笔记
V
OL
低输出电平
0.75
V
I
OH
I
OL
V
IL
V
IH
V
H
I
IL
C
IN
C
OUT
高级源电流
低电平灌电流
输入低电平
输入高电平
输入滞回
输入漏电流(绝对值)
对引脚作为输入容性负载
对引脚作为输出容性负载
10
25
2.1
60
1
3.5
3.5
0.8
10
10
mA
mA
V
V
mV
nA
pF
pF
文件编号: 38-12013牧师* M
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