EDR2518ABSE
Pin Configuration
80-ball FBGA (
µ
BGA)
Top View
10
9
8
7
6
5
4
3
2
1
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M
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R
U
10
9
8
7
6
5
4
3
2
1
A
GND
GND
V
DD
GND
GND
V
DD
V
DD
DQA8
CMD
DQA7
V
DD
DQA5
GND
DQA3
GNDa
DQA1
GNDa
CTMN
V
DD
CTM
V
DD
GND
GND
COL3
V
DD
COL1
V
DD
DQB1
GND
DQB3
GND
DQB5
VCMOS
DQB7
V
DD
DQB8
GND
V
DD
ROW2 ROW0
V
DD
GND
GND
DQA6
SCK
DQA4
DQA2
DQA0
CFM
GND
CFMN
ROW1
V
REF
COL4
GND
COL2
COL0
GND
DQB0
GND
DQB2
DQB4
SIO0
DQB6
SIO1
GND
GND
GND
V
DD
VCMOS GND
V
DD
V
DD
a
V
DD
V
DD
V
DD
V
DD
GND
GND
V
DD
B
C
D
E
F
G
H
J
K
L
M
N
P
R
S
T
U
Note
Some signals can be applied because this pin is not connected to the inside of the chip.
Preliminary Data Sheet
E0260E40 (Ver. 4.0)
3