EV1380数据手册版本A
针
49
50
51
53
54
名字
S_OUT
M / S
启用
AGND
POK
功能
数字输出。依赖于M / S引脚，或者是与时钟信号同步
内部开关频率或PWM信号是该引脚上输出。离开这个引脚
浮，如果它不被使用。
这是一个三元输入放。浮动销禁用并行操作。低水平
器件配置为主机和一个高级别配置设备作为从设备。
这是设备使能引脚。此引脚与VDDQ用10kΩ电阻。
这是控制电路的安静地。连接到接地平面与通过。
POK是逻辑与VDDQOK和EV1380的内部产生POK 。
POK是一个开漏逻辑输出，需要一个外部上拉电阻。 POK是
逻辑高电平时， VOUT是在-10 ％至VOUT标称的+ 10 ％ 。该引脚的保证
逻辑低，即使EV1380是完全无电。该引脚可下沉
最大4毫安。上拉电阻器可以被连接到一个电源以外
AVIN和VDDQ但电压应<3.6Volts 。
这是外部反馈输入引脚。一个电阻分压器从输出到连接
AGND 。中点的电阻分压器连接到VFB 。 （前馈
电容器需要在上部电阻器）的输出电压调节，以便
使VFB节点电压= VREF 。
可选误差放大器的输出。允许控制回路的定制。
外部参考电压输入。一个电阻分压器从VDDQ和AGND连接。
中点的电阻分压器被连接到VREF。电阻分压器具有
选择以应用到该引脚〜 0.4 * VDDQ电压。一个可选的电容
（软启动）可以连接从VREF到AGND 。
该引脚连接至VOUT 。
这是启用预偏置输入。当此引脚拉高时，设备将支持
启动预偏置负载下。该引脚被拉高内部。
55
VFB
56
57
EAOUT
VREF
58
59
60
61
VSENSE
EN_PB
62-63
69
FQADJ
此引脚与AGND通过一个13kΩ电阻。
VDDQOK这是一个高电平有效的输入引脚，用于指示外部提供VDDQ有
达到POK水平。该引脚应连接到VDDQ调节POK输出，或
如果让未使用的浮动。
NC （ SW ）无连接：这些引脚内部连接到共同的交换节点
内部的MOSFET。它们必须被焊接到印刷电路板，但不被电
连接到任何外部信号，地面，或电压。如果不遵守这一准则
可能会导致设备损坏。
保护地
设备散热垫连接到系统的GND平面散热
的目的。参见布局建议部分。
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