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MPC860SRZQ50D4 参数 Datasheet PDF下载

MPC860SRZQ50D4图片预览
型号: MPC860SRZQ50D4
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内容描述: PowerQUICC⑩系列硬件规格 [PowerQUICC⑩ Family Hardware Specifications]
分类和应用: 外围集成电路时钟
文件页数/大小: 80 页 / 1020 K
品牌: FREESCALE [ FREESCALE SEMICONDUCTOR, INC ]
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特点
系统集成单元( SIU )
- 公交车监控
- 软件看门狗
- 周期性中断定时器( PIT )
- 低功耗停止模式
•时钟合成器
- 递减器,时基和实时时钟( RTC )
- 复位控制器
- IEEE 1149.1 ™标准。测试访问端口(JTAG)
中断
- 七外部中断请求( IRQ )线路
- 12端口引脚具有中断功能
- 23个内部中断源
- 鳞癌之间可编程优先级
- 可编程的最高优先级请求
10/100 Mbps以太网的支持,符合IEEE 802.3u®标准完全兼容(不可用
使用ATM时,通过UTOPIA接口)
ATM支持符合ATM论坛UNI 4.0特定网络阳离子
- 电池在50 MHz的系统时钟处理高达50-70 Mbps的
- 细胞复用/解复用
- 支持AAL5和AAL0协议对每个VC的基础。 AAL0支持使OAM和
软件实现的其他协议。
- ATM的速度控制(APC )调度器,提供恒定比特率( CBR)的直接支持和
未规定比特速率(UBR ),并提供有利的软件支持的控制机制
可用比特率(ABR)
- 为UTOPIA ( 10/100 - Mbps的不支持此接口)和物理接口支持
字节对齐的串行(例如, T1 / E1 / ADSL)的
- UTOPIA -模式(ATM)支持1级高手与细胞级的握手,多PHY (最多四个
物理层器件)连接到25- , 51-或155 - Mbps的成帧器和UTOPIA /系统
1/2或1/3时钟比率。
- 串行模式(ATM)接口支持传输汇聚( TC )功能
T1 / E1 / ADSL线路,信元描述,元有效负荷加扰/解扰,自动
闲置/未分配的单元插入/剥,头差错控制( HEC )的生成,检查和
统计数据。
通信处理器模块( CPM )
- RISC的通信处理器(CP)的
- 通讯 - 特定网络C命令(例如,
正常停止TRANSMIT
,
ENTER HUNT
模式
RESTART TRANSMIT
)
- 支持所有串行通道连续模式下发送和接收
MPC860的PowerQUICC ™系列硬件规格,版本8
4
飞思卡尔半导体公司