引脚说明（续）
数
32, 33
符号
SP_V
EE
PCLK_OUT
水平
动力
TYPE
输入
描述
负电源。
对于最负电源连接
并行输出级。
输出时钟。
该设备采用PCLK_OUT的时钟输出
从DATA_OUT数据流[19 ：0] 。该时钟也被用于时钟
数据到GS1500的HDTV格式化或GS1510格式化。
正电源。
对于并行时钟最积极的电源连接
输出级。
负电源。
并行最负电源连接
时钟输出级。
并行数据输出总线。
该器件输出20位并行数据
上DATA_OUT运行在74.25或74.25 / 1.001MHz流[19 ：0] 。
DATA_OUT [19]为MSB和DATA_OUT [0]是LSB 。
34
TTL
产量
GS1545
35
PCLK_V
CC
PCLK_V
EE
DATA_OUT [19 ：0]的
动力
输入
36
动力
输入
41, 42, 43, 44,
45, 46, 47, 48,
49, 50, 53, 54,
55, 56, 59, 60,
61, 62, 63, 64
72
73
74
TTL
产量
LFA_V
CC
LFA
LBCONT
动力
类似物
类似物
输入
产量
输入
正电源。
环路滤波器最积极的电源连接。
控制信号输出。
控制电压为GO1515 VCO。
控制信号输入。
用于提供电子控制回路
带宽。
负电源。
环路滤波器最负电源的连接。
最负电源连接 - 使抖动
解调器的功能。该引脚应接地。如果
悬空， DM功能被禁用造成了目前的储蓄
340µA.
测试信号。
仅用于生产测试。
这些引脚必须悬空的正常运行。
75
76
LFA_V
EE
DFT_V
EE
动力
动力
输入
输入
79, 80
DM ， DM
类似物
产量
81, 85
86
LFS ， LFS
IJI
类似物
类似物
输入
产量
环路滤波器连接。
状态信号输出。
接近于过度抖动对量
传入和DDI DDI输入。
控制信号输入。
输入引脚交流耦合使用50Ω接地
传输线。
控制信号输入。
压控振荡器的输入。该引脚
连接到GO1515 VCO的输出引脚。
这个引脚必须通过一个50Ω连接到GO1515 VCO输出引脚
传输线。
89
VCO
类似物
输入
91
VCO
类似物
输入
93, 96
98
PLCAP ， PLCAP
PLL_LOCK
类似物
TTL
输入
产量
控制信号输入。
锁相检测时间常数电容。
状态指示信号。
这个信号是一个组合（逻辑与）
载波检测和相位锁定信号。
当输入的场合和PLL被锁定时， PLL_LOCK变高
且输出是有效的。当PLL_LOCK输出为低时，数据
输出被静音（锁在最后状态） 。
PLL_LOCK是独立的旁路信号。
105
绕行
TTL
输入
控制信号输入。
可选择的输入控制是否输入
信号是时钟恢复，或通过芯片通过。
当BYPASS高;输入信号是时钟恢复。
当BYPASS低;输入信号通过芯片传递和
没有时钟恢复。静音不影响旁路信号。
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