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GS88018AT-200I 参数 Datasheet PDF下载

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型号: GS88018AT-200I
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内容描述: 512K ×18 , 256K ×32 , 256K ×36 9MB同步突发静态存储器 [512K x 18, 256K x 32, 256K x 36 9Mb Sync Burst SRAMs]
分类和应用: 存储静态存储器
文件页数/大小: 26 页 / 734 K
品牌: GSI [ GSI TECHNOLOGY ]
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GS88018/32/36AT-250/225/200/166/150/133
100引脚TQFP
商用温度
工业级温度
特点
• FT引脚用户可配置的过流或管道
手术
•单周期取消( SCD )的操作
• 2.5 V或3.3 V +10 % / - 10 %,核心供电
• 2.5 V或3.3 V的I / O供电
• LBO引脚的直线或交错突发模式
•在模式引脚内部输入电阻允许浮动模式引脚
•默认为交错管道模式
•字节写( BW)和/或全局写( GW )的操作
•内部自定时写周期
•用于便携式应用的自动断电
• JEDEC标准的100引脚TQFP封装
管道
3-1-1-1
3.3 V
2.5 V
溢流
通过
2-1-1-1
3.3 V
2.5 V
t
KQ
TCYCLE
CURR
(x18)
CURR
(x32/x36)
CURR
(x18)
CURR
(x32/x36)
t
KQ
TCYCLE
CURR
(x18)
CURR
(x32/x36)
CURR
(x18)
CURR
(x32/x36)
-250 -225 -200 -166 -150 -133单位
2.5 2.7 3.0 3.4 3.8 4.0纳秒
4.0 4.4 5.0 6.0 6.7 7.5纳秒
280
330
275
320
5.5
5.5
175
200
175
200
255
300
250
295
6.0
6.0
165
190
165
190
230
270
230
265
6.5
6.5
160
180
160
180
200
230
195
225
7.0
7.0
150
170
150
170
185
215
180
210
7.5
7.5
145
165
145
165
165
190
165
185
8.5
8.5
135
150
135
150
mA
mA
mA
mA
ns
ns
mA
mA
mA
mA
512K ×18 , 256K ×32 , 256K ×36
9MB同步突发静态存储器
250兆赫, 133兆赫
2.5 V或3.3 V V
DD
2.5 V或3.3 V的I / O
周期可以与任何ADSP ADSC或输入来启动。在
连拍模式下,会产生后续的突发地址
在内部,并通过ADV控制。突发地址
计数器可以被配置成在计算的线性或
交错为了与线性突发顺序( LBO )的输入。该
突发功能不需要使用。新的地址可以被装载
在每一个周期用的芯片性能不劣化。
流经/管道读取
的数据输出寄存器的功能可以通过控制
通过FT模式引脚用户(引脚14 ) 。抱着FT模式引脚
低额的RAM中通过流模式,导致输出
数据绕过数据输出寄存器。控股FT高
放置在管道模式的RAM中,激活的上升,边沿
触发数据输出寄存器。
SCD流水线读
该GS88018 / 32 / 36AT是SCD (单循环取消)
流水线同步SRAM 。 DCD (双循环取消)
版本也可以。 SCD的SRAM管线取消
命令一期比读取命令少。 SCD的RAM
开始取消选择后,立即关闭其输出
命令已被捕获在所述输入寄存器。
字节写和全局写
通过使用字节写使能进行字节写操作
(BW)的输入与一个或多个单独的字节的写
信号( Bx的) 。此外,全局写( GW)是供
写的字节写入所有字节在同一时间,不管
控制输入。
睡眠模式
低功耗(休眠模式)通过断言实现
(高)的ZZ的信号,或通过停止时钟(CK) 。
在休眠模式下的内存数据将被保留。
功能说明
应用
该GS88018 / 32 / 36AT是9437184位( 8,388,608位为
X32版本)的高性能同步SRAM与
2位爆裂地址计数器。虽然一个类型的原本
对于二级缓存的应用程序支持开发高
高性能CPU ,该装置现在发现应用
同步SRAM应用,从DSP主
存储网络芯片组的支持。
核心和接口电压
该GS88018 / 32 / 36AT工作在2.5 V或3.3 V电源
供应量。所有的输入都是3.3 V和2.5 V兼容。另
输出功率(V
DDQ
)引脚用于去耦输出噪声
从内部电路和分别为3.3 V和2.5 V兼容。
控制
地址,数据I / O的芯片使能( E1,E2, E3) ,地址脉冲串
控制输入​​( ADSP , ADSC , ADV ) ,写控制输入
( Bx的,BW , GW)是同步的,并通过一个控制
正边沿触发的时钟输入端( CK) 。输出使能( G)
和断电控制( ZZ )是异步输入。爆
冯: 1.02 9/2002
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©2001 ,千兆半导体公司
规格援引如有更改,恕不另行通知。对于最新的文档,请参见http://www.gsitechnology.com 。