V385GLF 参数 Datasheet PDF下载

V385

8-B

IT

LVDS牛逼

变送器FOR

V

IDEO

概述

在V385发射器转换为3.3 V 28位

CMOS / TTL到4低电压差分信号

（LVDS）的数据流的同时传输时钟输入是

平行地多的第五数据流发送

LVDS链路。的V385可以编程为上升

边缘或通过引脚R_FB下降沿时钟。

ICS制造了大量的各种视频应用

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要求。

特点

•

引脚和功能与国家相兼容

DS90C385 ， TI SN65LVDS93和你

THC63LVDM83

•

转换为3.3 V CMOS / TTL 28位到4 LVDS

流

•

高达2.38 Gbps的吞吐量和297.5兆字节/秒

带宽

引脚分配

VCC

TxIN5

TxIN6

TxIN7

GND

TxIN8

TxIN9

TxIN10

VCC

TxIN11

TxIN12

TxIN13

GND

TxIN14

TxIN15

TxIN16

R_FB

TxIN17

TxIN18

TxIN19

GND

TxIN20

TxIN21

TxIN22

TxIN23

VCC

TxIN24

TxIN25

1

2

3

4

5

6

7

8

9

10

11

12

13

14

15

16

17

18

19

20

21

22

23

24

25

26

27

28

56

55

54

53

52

51

50

49

48

47

46

45

44

43

42

41

40

39

38

37

36

35

34

33

32

31

30

29

TxIN4

TxIN3

TxIN2

GND

TxIN1

TxIN0

TxIN27

LVDS_GND

TxOUT0-

TxOUT0+

TxOUT1-

TxOUT1+

LVDS_VCC

LVDS_GND

TxOUT2-

TxOUT2+

TXCLKOUT-

TXCLKOUT +

TxOUT3-

TxOUT3+

LVDS_GND

PLL_GND

PLL_VCC

PLL_GND

PWRDWN

TXCLKIN

TxIN26

GND

•

•

•

•

•

•

•

•

•

•

宽时钟频率为20兆赫到85兆赫

扩频兼容

支持VGA ，SVGA，XGA ， SXGA的和

350 mV的LVDS电压摆幅低EMI

片上PLL无需外部组件

单3.3 V低功耗CMOS设计

可编程的上升沿或下降沿频闪

断电控制功能

兼容TIA / EIA- 644 LVDS标准

封装采用56引脚TSSOP （无铅可用）

框图

红，绿，蓝

HSYNC

VSYNC

数据启用

控制

TxOUT2-

R_FB

PWRDWN

时钟

PLL

TXCLKOUT-

TxOUT3+

TxOUT3-

TXCLKOUT +

TTL到

LVDS

TxOUT1-

TxOUT2+

24

TxOUT0+

TxOUT0-

TxOUT1+

56引脚TSSOP

V385数据表

1

3/30/05

修订版1.6

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