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IDT72V245L15PF 参数 Datasheet PDF下载

IDT72V245L15PF图片预览
型号: IDT72V245L15PF
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内容描述: 3.3伏的CMOS SyncFIFO 256 ×18 , 512 ×18 , 1024 ×18 , 2048 ×18 ,以及4096 ×18 [3.3 VOLT CMOS SyncFIFO 256 x 18, 512 x 18, 1,024 x 18, 2,048 x 18, and 4,096 x 18]
分类和应用: 先进先出芯片
文件页数/大小: 25 页 / 216 K
品牌: IDT [ INTEGRATED DEVICE TECHNOLOGY ]
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IDT72V205 / 72V215 / 72V225 / 72V235 / 72V245 3.3V CMOS SyncFIFO
TM
256 ×18 , 512 ×18 , 1024 ×18 , 2048 ×18 ,4096 ×18
商业和工业
温度范围
t
CLKH
RCLK
t
ENS
t
REF
EF
t
A
Q
0
- Q
17
t
OLZ
t
OE
t
ENH
t
CLK
t
CLKL
无操作
t
REF
有效数据
t
OHZ
OE
t
SKEW1
WCLK
(1)
4294 DRW 07
注意事项:
1. t
SKEW1
是一个上升缘WCLK和RCLK上升边缘,以保证之间的最小时间
EF
将在当前时钟周期变为高电平。如果上升沿之间的时间
WCLK的边缘和RCLK的上升沿小于吨
SKEW1
,然后
EF
可以不改变状态,直到下一RCLK边缘。
2.通过设置选择此模式( FL,
RXI , WXI )
= ( 0,0,0 ) , ( 0,1,1 ) , ( 1,0,0 )或( 1,1,1)复位过程中。
图7.读周期时序与单个寄存器缓冲
EF
( IDT标准模式)
WCLK
t
DS
D
0
- D
17
t
ENS
t
SKEW1
RCLK
t
REF
EF
t
ENS
t
A
Q
0
- Q
17
t
OLZ
t
OE
OE
4294 DRW 08
D
0 (第一次有效的写操作)
D
1
D
2
D
3
D
4
t
FRL (1)
t
A
D
0
D
1
注意事项:
1.在t
SKEW1
最低规格,T
FRL
(最大值) = T
CLK
+ t
SKEW1
。当t
SKEW1
& LT ;最低规格,T
FRL
(最大值) = 2或者* T
CLK
+ t
SKEW1
或T
CLK
+ t
SKEW1
。该
延迟时间仅适用于空边界( EF = LOW) 。
2.第一个字是后可循环
EF
变高时,总是如此。
3.通过设置选择此模式( FL,
RXI , WXI )
= ( 0,0,0 ) , ( 0,1,1 ) , ( 1,0,0 )或( 1,1,1)复位过程中。
图8.第一个数据字延迟与单个寄存器缓冲
EF
( IDT标准模式)
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