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型号: LXT351QE
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内容描述: PCM收发器|单| CEPT PCM - 30 / E - 1 | CMOS | QFP | 44PIN |塑料\n [PCM TRANSCEIVER|SINGLE|CEPT PCM-30/E-1|CMOS|QFP|44PIN|PLASTIC ]
分类和应用: 电信集成电路PC
文件页数/大小: 46 页 / 1070 K
品牌: INTEL [ INTEL CORPORATION ]
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T1 / E1短程收发器与晶体抖动衰减 - LXT351
2.3
接收器
1:1的变压器提供接口的双绞线​​线路。恢复的数据是在RPOS输出/
RNEG ( RDATA在单极模式下) ,并且恢复的时钟是在RCLK输出。请参阅
用于接收时序规范。
2.3.1
接收数据恢复
所述收发滤波器均衡信号,并将其应用到峰值检测器和数据限幅器。该
峰值检测器信号的采样值,并确定接收的信号的最大值。该
数据限幅器被设定为峰值的50%,以确保最佳的信号与噪声的性能。
通过该数据限幅器处理后,接收的信号进到所述数据和定时恢复
部,然后向B8ZS / HDB3解码器(如果选择) ,并在接收显示器。的数据,并
定时恢复电路提供输入抖动容限显著优于要求的AT&T
酒吧62411和ITU G.823 。请参阅“测试规范”一节。
恢复的数据被发送到信号( LOS )显示器的损失,并通过告警指示
信号( AIS ,蓝色警报)显示器。抖动衰减器( JA )可以启用或禁用
接收数据的路径,或在发射路径。接收的数据可被路由至任一B8ZS或HDB3
解码器或两者都不是。最后,该装置可以发送数字数据到成帧器为单极性或
双极性数据。
当单极传输数据的成帧器,设备报告的接收双极性侵犯的
驾驶BPV引脚为高电平。在E1的操作,该设备可以报告HDB3码和违规
零换人违例的BPV引脚。
2.4
抖动衰减
抖动衰减环路( JAL )与弹性存储( ES)提供,如图抖动衰减
测试规范部分。日航并不需要特别的电路,例如,一个外部石英
晶体或高频时钟(比线路速率更高)。其时序参考MCLK 。
位CR1.JASEL0启用或禁用JA电路。与位CR1.JASEL0 = 1,位CR1.JASEL1
控制JA电路布局(见
在ES可以是32 ×2位或64
×2位的寄存器取决于位CR3.ES64的值(见
该器件的时钟数据到ES使用或者TCLK或RCLK取决于是否JA
电路是在发送或接收数据的路径,分别。数据被移出弹性存储器的
使用从日航的dejittered时钟。当FIFO内溢出或两个位
下溢,在ES通过调节输出时钟
1
/
8
一个位周期。在ES生产的平均
延迟的16位(或32位,与所选择的64位的ES选项)中的相关联的数据路径。当
抖动衰减器的接收路径,输出RCLK顺利过渡到MCLK的
事件的LOS条件。
过渡状态寄存器的位TSR.ESOVR和TSR.ESUNF表明弹性商店
溢或下溢,分别。请注意,这些都是曾经设置为1位粘,保持设置
直到主机读取寄存器。在ES还可以提供一个可屏蔽中断的上溢或
下溢流。
数据表
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