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ISPLSI3256A-70LQI 参数 Datasheet PDF下载

ISPLSI3256A-70LQI图片预览
型号: ISPLSI3256A-70LQI
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内容描述: 在系统可编程高密度PLD [In-System Programmable High Density PLD]
分类和应用: 可编程逻辑器件输入元件时钟
文件页数/大小: 13 页 / 164 K
品牌: LATTICE [ LATTICE SEMICONDUCTOR ]
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特定网络阳离子
可编程逻辑器件3256A
外部开关特性
1, 2, 3
在推荐工作条件
TEST
2
参数
#
电导率。
5
描述
1
-90
3
-70
77.0
50.0
83.0
9.5
0.0
11.0
0.0
10.0
6.0
6.0
5.0
0.0
15.0
18.0
9.0
10.5
15.0
18.0
18.0
11.0
11.0
17.0
17.0
-50
20.0
24.5
分钟。马克斯。分钟。马克斯。分钟。马克斯。
12.0
15.0
7.5
9.0
13.5
16.0
16.0
10.0
10.0
10.0
10.0
单位
ns
ns
兆赫
兆赫
兆赫
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
t
pd1
t
pd2
f
最大
f
MAX(分机)
f
MAX( TOG )。
t
su1
t
co1
t
h1
t
su2
t
co2
t
h2
t
r1
t
rw1
t
ptoeen
t
ptoedis
t
goeen
t
goedis
t
toeen
t
toedis
t
wh
t
wl
t
su3
t
h3
1.
2.
3.
4.
5.
A
A
A
A
A
B
C
B
C
B
C
1数据按比例延迟, 4PT绕道, ORP绕道
2数据按比例延迟
3 CLK频率与内部反馈
4 CLK频率与分机。反馈
5 CLK频率最高。切换
4
90.0
61.0
125
8.0
0.0
9.0
0.0
6.5
4.0
4.0
0.0
57.0
37.0
63.0
12.5
0.0
(
tsu21 + tco1
)
6 GLB注册。 CLK, 4 PT绕道前建立时间
7 GLB注册。 CLK到输出延迟, ORP绕道
8 GLB注册。 CLK, 4 PT绕道后保持时间
9 GLB注册。之前的Clk建立时间
10 GLB注册。 CLK到输出延迟
11 GLB注册。 Clk时后保持时间
12分机。复位引脚输出延迟
13分机。复位脉冲持续时间
14输入到输出使能
15输入到输出禁止
16全球OE输出使能
17全球OE输出禁止
18测试OE输出使能
19测试OE输出禁止
20分机。同步的Clk脉冲持续时间,高
21分机。同步的Clk脉冲持续时间,低
内线后, 23 I / O寄存器保持时间。同步了CLK( Y3 , Y4 )
22 I /分机之前Ø注册设置时间。同步了CLK( Y3,Y4 )5.0
除非另有说明,所有参数均采用20 PTXOR路径和ORP 。
请参阅时序模型在此数据表的进一步细节。
标准的16位计数器使用GRP反馈。
FMAX
(切换)可小于1 /( +亿千瓦时
TWL ) 。
这是为了允许其他的超过50%的时钟占空比。
参考切换测试条件部分。
6
使用3256A-
70
新DESIG
NS
12.0
15.0
0.0
14.0
20.0
24.5
24.5
13.5
13.5
23.0
23.0
13.5
8.0
8.0
7.0
0.0
表2-0030C / 3256A