LF43891JC40 参数 Datasheet PDF下载

型号：	LF43891JC40
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内容描述：	9× 9位数字滤波器 [9 x 9-bit Digital Filter]
分类和应用：	外围集成电路LTE时钟
文件页数/大小：	11 页 / 81 K
品牌：	LOGIC [ LOGIC DEVICES INCORPORATED ]

LF43891

设备公司

9× 9位数字滤波器

IGURE

安输出

TAGE

IAGRAM

SHADD

ADR

2-0

FILTER小区描述

9位的系数被加载到

C寄存器（ CIN

8-0

），并作为输出

COUT

8-0

（该COENB信号使

在COUT

8-0

输出）。路径

采取的系数变化

根据抽取模式

选择。由于没有抽取的

直接从系数移动

C寄存器，绕过所有抽取

寄存器，并且可在

输出上下面的时钟周期。

当抽取选定后，

系数输出由1延迟，2，

或3个时钟周期，这取决于如何

许多抽取注册

系数通过（ D1，D2，或

D3）。抽取的数

注册系数传递

通过由DCM确定

1-0

请参考表1选择

抽取模式。

CIENB使C和D寄存器

对于系数加载。寄存器

在CLK的上升沿被装入

当CIENB低。 CIENB是

锁存，并在内部延迟而

能够装载一个寄存器

时钟周期之后CIENB变为有效

（载荷发生在第二

上升CLK边缘CIENB去后

LOW ）。因此， CIENB必须

前低一个时钟周期

系数被放置在CIN的

8-0

输入。这些系数被保持时

CIENB高。

DIENB使X寄存器的

加载数据。 X寄存器是

在CLK的上升沿装入

当DIENB低。 DIENB是

锁存，并在内部延迟（负载

ING发生在第二上升

CLK的DIENB后缘变低）。

因此， DIENB要低1

数据之前的时钟周期被放置在

在DIN

8-0

输入。 X寄存器是

装载全部为零时DIENB是

高。

C寄存器的C的输出（

8-0

）和

X寄存器（X

8-0

）提供的输入

在9× 9乘法。乘数是

跟着两个流水线寄存器，

CELL结果

MUX

零

MUX

标志

延期

25-18

17-0

产量

卜FF器

25-8

产量

MUX

SENBL

SENBH

三州

卜FF器

CLK

RESET.D

所有的寄存器

M REG0和M REG1 。的输出

乘法器符号扩展，并

作为其中的一个输入到26位的

加法器。该26位的输出

蓄能器提供第二

输入到加法器。双方把累加器

荡器和T寄存器加载simul-

taneously用的输出

加法器。

蓄压器中装入

加法器的每一个时钟输出

周期，除非清除。清除

蓄能器可以使用能够实现

两种方法。第一种方法中，当

无论RESET和擦除低，

导致所有累加器和所有

在设备寄存器清零

在一起。 RESET和ERASE是

锁存，并在内部延迟caus-

荷兰国际集团的信息交换发生在第二

经过一个时钟周期复位和擦除去

活跃的。

在第二种方法中，只有当

ERASE为低，清除一个准确

mulator选定的单元格。该细胞是

使用ADR选择

2-0

输入

（解码单元n ）。 ERASE被锁定

和延迟内部引起

结算发生在第二个时钟

擦除周期后变为有效。参考

表2用于清除寄存器和

蓄能器。

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