512MB， 1GB，2GB ： P30-65nm
配置寄存器
表16 ：突发序列的字顺序（续）
突发寻址过程（DEC）
开始
地址
（ DEC）
4
5
6
7
⋮
14
15
BURST
WRAP
(RCR3)
1
1
1
1
⋮
1
1
⋮
4字突发
（BL [2：0 ] =
0b001)
8字突发
（BL [2：0 ] = 0b010 ）
4-5-6-7-8-9-10-11
5-6-7-8-9-10-11-12
6-7-8-9-10-11-12-13
7-8-9-10-11-12-13-14
⋮
16字突发
（BL [2：0 ] = 0b011 ）
4-5-6-7-8…18-19
5-6-7-8-9…19-20
6-7-8-9-10…20-21
7-8-9-10-11…21-22
⋮
14-15-16-17-18…28-29
15-16-17-18-19…29-30
可连拍
（BL [2：0 ] = 0b111 ）
4-5-6-7-8-9-10…
5-6-7-8-9-10-11…
6-7-8-9-10-11-12-…
7-8-9-10-11-12-13…
⋮
14-15-16-17-18-19-20-…
15-16-17-18-19-20-21-…
时钟边沿
时钟边缘（ CE ）位选择上升（默认）或下降时钟边沿的CLK 。这
时钟沿是用在一个脉冲串周期的开始，以输出同步数据，并
断言/解除断言等待。
突发裹
突发包（ BW ）位决定4字， 8字或16字突发长度
存取所选择的字长度的界限或交叉字长boun-内包
daries 。当BW设置，突发包装不会发生（默认值） 。当带宽被清除，
包装爆裂发生。
当执行同步突发读取与BW集（无包装） ，输出延迟可能
当突发序列跨越了第一排的设备（ 16字）边界发生。如果
爆序列的起始地址是4字对齐的，则没有延迟。如果AD-开始
礼服是在一个4字边界结束，最坏情况下的输出延迟一个时钟周期
比第一存取延迟计数少。这个延迟可以只进行一次，并且不
如果突发序列不交叉器件行的边界发生。等待通知
当发生这种延迟的系统。
突发长度
脉冲串长度位（ BL [ 2：0] ），选择线性脉冲串长度为所有同步脉冲串
读取闪存阵列。突发长度为4个字， 8字， 16字，或CON-
连续的。
连续突发的访问只是线性的，没有在任何字长包装
边界。当一个突发周期开始时，器件输出的同步突发数据，直到
它到达“破裂的”地址空间的末端。
PDF ： 09005aef845667b3
p30_65nm_MLC_512Mb - 1gb_2gb.pdf - 版本B 12/13 EN
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