VP2615 参数 Datasheet PDF下载

型号：	VP2615
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内容描述：	H.261解码器 [H.261 Decoder]
分类和应用：	解码器
文件页数/大小：	11 页 / 137 K
品牌：	MITEL [ MITEL NETWORKS CORPORATION ]

VP2615

引脚说明

DIN7 ： 0

此端口用于输入量化后的变换

数据和控制信息。它的功能是

通过DMODE3确定： 0 。数据移入

在DCLK的上升沿。

这个输入控制DIN7的功能： 0 。数据

被时钟在DCLK的上升沿。

OE2

DCLK

这个信号被用于在数据在DIN选通

和DMODE投入。 DCLK可以有效地将

通过对输入等待状态禁用

DMODE 。 DCLK必须通过将导出

系统时钟与一个大于1的整数。

这YUV块格式总线输出像素数据

在季SYSCLK的频率。

这种同步输出脉冲高两

出现有效像素的数据时，系统时钟周期

在YUV端口。它仍然很低时无效。

此同步的输出变为高电平的第一

一个新的宏块的周期，并保持高电平，直到

该宏数据块的最后的像素已经

输出。在宏观块MBOUT的端

变低，直到新的宏观块开始。

这种同步输出为高电平，表示

一个新的框架即将开始的YUV端口。

它保持高，直到最后一个象素被输出。然后，

FRMOUT变低，直到一个新的帧开始。

用于读取和写入到外部数据总线

DRAM帧存储。

地址总线控制外部DRAM

帧存储。

行地址选通控制外部

DRAM帧存储。

列地址选通信控制外部

DRAM帧存储。

CBUS7 ： 0

RW1

RW2

OE1

DMODE3 ： 0

读/写控制的外部DRAM 1 。

读/写控制的外部DRAM 2 。

输出使能控制外部DRAM 1

或者，如果ADR8 256K DRAM的使用。

输出使能控制外部DRAM 2

N / C ，如果256K的DRAM使用。

用于通过一个microproc-使用双向数据总线

ESSOR 。数据和指令的时钟上

关上的CSTR的上升沿的芯片。

这个输入选通的数据的输入和输出的

CBUS端口。

当该引脚为低电平时， CBUS口

可以用来输入或输出数据。

当高该信号定义CBUS数据，

而当作为指令低。

系统时钟为27MHz的最大运行。

系统时钟必须保持高度的35 ％至65％

每个周期。所有内部时钟衍生自

这个时钟。

低电平有效复位。必须保持低电平至少

2048次上电。如果RESET使用

操作过程中，所有的前一帧的数据将

丢失。

测试时钟为JTAG

测试模式选择为JTAG （拉高）。

JTAG复位引脚（拉高）。

输入JTAG测试数据（拉高）。

输出JTAG测试数据。

YUV7 ： 0

CSTR

Vpix的

CEN

CADR

MBOUT

系统时钟

FRMOUT

RESET

FS15 ： 0

TCK

TMS

TRST

ADR7 ： 0

RAS

TDI

TDO

CAS

注意：

"Barred"低电平有效的信号没有出现在该棒

文本的主体。

CBUS [7 ：0]的

CSTR CADR

CEN

控制I / F

DCLK

DIN [7：0 ]

DMODE [3 ：0]的

输入

调节器

行程

解码&

INV曲折

逆

量化

逆

DCT

添加

低通

滤波器

FRMOUT

MBOUT

Vpix的

YUV [7：0 ]

帧存储控制器

ADR [7：0 ]的FS [15：0 ] OE1 OE2

RW1 RW2

RAS CAS

图2 ：简化框图

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