（五）申请启动转换脉冲，而转换时，
进度（ EOC =逻辑"1" ）将启动一个新的，可能
不准确的转换周期。同时从中断的数据
而随后的转换将是无效的。
6.不要启用/禁用或补输出位或
在转换过程中，从FIFO读出（从
EOC的上升沿到EOC下降沿） 。
7.溢出位（引脚33 ）开关从0到1的时候
输入电压超过其生产的所有的输出
为1或当输入等于或超过电压
生产全0 。当COMP BITS被激活时，在上述
条件下是相反的。
在FIFO之后立即在第一次转换已经
完成并停留在那里，直到FIFO读取。
如果输出三态寄存器已启用（逻辑"0"
施加到引脚34） ，从所述第一转换的数据将显示在
在ADS -935的输出端。尝试写一个17字
到FIFO已满将导致该数据，以及任何后续
转换数据，丢失。
当FIFO满（由FSTAT1和FSTAT2均显示
等于"1" ），它可以通过删除在FIFO读线读
（引脚9）为逻辑QUOT ; 0 ＆ QUOT ;然后将一系列的15上升
边缘到读取线。由于第一数据字已经
在FIFO输出端，所述第一读命令本（第一
上升应用于FIFO读边）将带来从数据
第二转换到输出端。以后每次读
命令/上升沿使下一个字的输出线。
后15上升沿带来了第16届数据字的
FIFO输出，在读取后续下降沿将更新
状态输出（一个最大20ns的延迟之后） FSTAT1 =
0,
FSTAT2 = 1指示FIFO是空的。
如果将读命令在FIFO清空之后发出，最后
字（ 16日转换）将继续出现在输出端。
内部FIFO操作
在ADS- 935包含一个内部用户发起的， 18位， 16位
字FIFO存储器。在FIFO中的每个字包含16
数据比特以及MSB和溢出位。引脚8 （ FIFO /
DIR ）和图9 （FIFO读出）控制的FIFO的操作。该
FIFO的状态可以通过读引脚10进行监测（ FSTAT1 ）
和11 （ FSTAT2 ） 。
当引脚8 （ FIFO / DIR ）具有逻辑"1"应用， FIFO为
插入到数字数据路径。当引脚8具有逻辑"0"
施加时，FIFO是透明的和输出数据进
直接输出三态寄存器（其操作方法
通过34引脚控制（ ENABLE ） ） 。读写命令
到FIFO时， ADS- 935中的操作将被忽略
＆ QUOT ;直接＆ QUOT ;模式。它最多需要20ns的切换FIFO的
或缩小的ADS- 935的数字数据路径。
FIFO重置功能
在任何时候，在FIFO可以通过将被重置为空的状态
在ADS- 935进入其"direct"模式（逻辑"0"适用于针8 ，
先进先出/ DIR ），并且还施加一个逻辑"0"向FIFO读
线（ 9针） 。 FIFO的空的状态将通过指示
FSTAT1去一个"0" ，并FSTAT2去一个"1".状态
施加控制信号后输出变化为40ns 。
FIFO的写入和读取模式
一旦FIFO已启用（引脚8的高点） ，数字数据
自动写入到它，而不管FIFO的状态
阅读（ 9脚） 。假设FIFO最初是空的，它会
接受来自下一个16个连续的A / D数据（18位字）
转换。作为预防措施， 9脚（控制FIFO的
读功能）应该不低时，数据首先写入
FIFO为空。
当FIFO最初是空的，数字化从所述第一数据
转化率（在"oldest"数据）出现在输出
FIFO状态， FSTAT1和FSTAT2
通过读取两个显示器FIFO中的数据的状态
状态引脚， FSTAT1 （引脚10）和FSTAT2 （引脚11 ） 。
目录
空（ 0字）
＆ LT ;半满（小于8个字）
半满或以上（ 8字）
全部（ 16字）
FSTAT1
0
0
1
1
FSTAT2
1
0
0
1
表1. FIFO延迟
延迟
直营模式为FIFO启用
FIFO使能直接模式
FIFO读取输出数据有效
FIFO改变时，读到的状态更新
从<half满（ 1个字） ，以空
FIFO改变时，读到的状态更新
从半满（ 8个字） ，以<half满（ 7字）
FIFO改变时，读到的状态更新
从全（ 16字）至半满（ 15字）
书写时下降EOC的边缘状态更新
第一个字到FIFO空
EOC下降的边缘时，状态更新
改变从FIFO满<half （ 7字）
半满（ 8个字）
EOC下降到状态更新的边缘填充时
FIFO与第16话
针
8
8
9
9
9
9
32
32
32
过渡
1
0
1
0
1
0
1
0
1
0
0
1
1
1
1
分钟。
–
–
–
–
–
–
–
–
–
典型值
.
10
10
–
–
–
–
–
–
–
马克斯。
20
20
40
20
110
190
190
110
28
单位
ns
ns
ns
ns
ns
ns
ns
ns
ns
0
0
0
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MURATA-PS [ MURATA POWER SOLUTIONS INC. ]
