半导体¡
PWI ， AOUT + ， AOUT-
MSM7507-01/02/03
PWI被连接到接收驱动器的反相输入端。接收驱动器输出
连接到AOUT-销。因此，接收电平可以被调节到与销VFRO ，
PWI和AOUT- 。当不使用该PWI的销，所述的PWI销连接到AOUT-销，并
离开打开销AOUT-和AOUT + 。 AOUT +的输出反相相对于所述
输出AOUT-的。由于信号从其中提供了1.2的阻抗的差分驱动
千瓦，这些输出可以被直接使用压电连接到手持机的接收器
耳机。指的是应用例。
VI
接收滤波器
VFRO
PWI
R6
R7
R6 > 20千瓦
ZL
≥
1.2千瓦
增益= VO / VI = 2
¥
R7/R6
£
2
SG
–
+
Aout-
VO
ZL
SG
–
+
AOUT +
在节能和省电模式， AOUT +和AOUT-的输出为高
阻抗状态。
在AOUT-引脚和AOUT +引脚的电驱动能力
±1.3
V最大。该
输出负载电阻为0.6千瓦的最小值。
如果一个输出幅度小于
±1.3
V是允许的，这些输出可以驱动一个负载电阻较小
除以上所描述的。有关详细信息，请参阅单电源PCM编解码器
应用笔记。
V
DD
电源为+ 5V。
PCMIN
PCM信号输入。
串行PCM信号输入到该引脚被转换为模拟信号同步于
RSYNC信号和BCLK信号。
在PCM信号的数据速率等于BCLK信号的频率。
该PCM信号被移位在BCLK信号的下降沿和锁存到内部寄存器
当用8位偏移。
PCM数据的开始（ MSD）的识别在RSYNC的上升沿。
BCLK
移位时钟信号输入为PCMIN和PCMOUT信号。
的频率，等于所述数据传输率，是64 ，96 ，128， 192 ，256， 384 ， 512 ， 768 ， 1024 ， 1536 ， 1544 ， 2048 ，
或200千赫。这个信号设置为逻辑"1"或"0"驱动器发送和接收电路的
省电状态。
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