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4302-02 参数 Datasheet PDF下载

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型号: 4302-02
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内容描述: 50欧姆RF数字衰减器6位, 31.5分贝, DC- 4.0 GHZ [50 Ohm RF Digital Attenuator 6-bit, 31.5 dB, DC-4.0 GHZ]
分类和应用: 衰减器
文件页数/大小: 11 页 / 458 K
品牌: PEREGRINE [ PEREGRINE SEMICONDUCTOR CORP. ]
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PE4302
产品speci fi cation
编程选项
并行/串行选择
并行或串行接口可以用于
控制PE4302 。在P / S位提供了这种
选择具有P / S = LOW选择水货
接口和P / S =高选择所述串行
界面。
并行接口模式
并行接口包括5个CMOS-
即选择所需的兼容控制线
衰减的状态,在表5所示。
并行接口的时序要求
由图18 (并行接口时序定义
图) ,表9 (并行接口AC
特性) ,并且开关速度(表1) 。
LATCHED
并行编程的锁存使能
( LE )应保持低电平,同时改变衰减
国家控制值,则脉冲LE高电平变为低电平
(每图18 ),以锁定新的衰减状态进入
装置。
直接
并行编程的锁存使能
( LE )线应拉高。改变
衰减状态控制值将更改设备
国家新的衰减。直接模式是理想的
手动控制装置(使用硬线,
开关或跳线) 。
时钟和锁存使能( LE ) 。数据和时钟
输入允许数据被串行输入到移位
登记,这个过程是独立的状态
在LE的输入。
勒输入控制锁存器。当LE为高电平时,
锁存器是透明的,串行的内容
移位寄存器控制衰减器。当LE是
带来LOW时,在移位寄存器中的数据进行锁存。
而LE举行的移位寄存器应该被加载
低,以防止衰减器值从变化的
作为数据输入。然后, LE输入应该是
切换为高,拉低再次,锁存
新的数据。用于此操作的时序被定义
图17 (串行接口时序图)和
表8 (串行接口AC特性) 。
电控制设置
该PE4302总是假定一个可指定
在上电时的衰减设置。此功能存在
为串行和并行操作模式,
并允许已知的衰减状态,以
最初的串行或并行控制之前成立
提供单词。
当衰减权力在串行模式(P /
S = 1 ),则6的控制位被设置为任何数据是
本上的六个并行数据输入( C0.5至C16 ) 。
这允许将64衰减设置到任何一个
被指定为开机状态。
当衰减权力在并行模式(P /
S = 0 )与LE = 0,则控制位被自动置
到的四个可能的值之一。这四个值
由两个电控制比特, PUP1被选择
和PUP2 ,如表6所示, (上电真相
表,并联方式) 。
表5.真值表
P / S
0
0
0
0
0
0
0
0
C16
0
0
0
0
0
0
1
1
C8
0
0
0
0
0
1
0
1
C4
0
0
0
0
1
0
0
1
C2
0
0
0
1
0
0
0
1
C1
0
0
1
0
0
0
0
1
C0.5
0
1
0
0
0
0
0
1
衰减
状态
引用亏损
0.5分贝
1分贝
2分贝
4分贝
8分贝
16分贝
31.5分贝
表6.并行PUP真值表
P / S
0
0
0
0
LE
0
0
0
0
1
PUP2
0
1
0
1
X
PUP1
0
0
1
1
X
衰减状态
引用亏损
8分贝
16分贝
31分贝
由定义
C0.5-C16
注意: C0.5 〜C16的不是所有的64种可能的组合示于表
串行接口
串行接口是一个6位的串行入,并行出
移位寄存器由透明锁存器缓冲。这是
三CMOS兼容信号控制:数据,
0
注:电源与LE = 1为正常的并行操作
C0.5 - C16和PUP1和PUP2不活跃。
©2005 Peregrine半导体公司保留所有权利。
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文件编号70 / 0056 〜 02D
的UltraCMOS RFIC ™解决方案