2007年2月
P1707A
修订版1.2
引脚配置
CLKIN
1
8
7
6
5
NC
SR0
SR1
SSON / SBM
VDD
2
VSS
3
P1707A
MODOUT
4
引脚说明
针＃
1
2
3
4
5
6
7
8
引脚名称
CLKIN
VDD
VSS
MODOUT
SSON / SBM
SR1
SR0
NC
TYPE
I
P
P
O
I
I
I
-
描述
连接到外部生成的时钟信号。把一部分进入待机模式，
禁止输入时钟信号，该引脚拉SSON / SBM （引脚5 ）低。
参考
待机模式选择表。
连接到+ 3.3V 。 （放置一个0.1μF的去耦靠近引脚和地面）
接地连接。连接到系统地。
扩频时钟输出。
扩频开/关和待机模式控制。
请参阅待机模式
选择表。
该引脚具有内部上拉电阻。
数字逻辑输入来选择传播范围。
是指扩频
选择表。
该引脚具有内部上拉电阻。
数字逻辑输入来选择传播范围。
是指扩频
选择表。
该引脚具有内部上拉电阻。
无连接。
待机模式选择
CLKIN
残
残
启用
启用
SSON / SBM
0
1
0
1
传播
SPECTRUM
不适用
不适用
关闭
On
MODOUT
残
残
参考
正常
PLL
残
自由运行
残
正常
模式
待机
自由运行
缓冲输出
正常
传播范围选择
SR1
0
0
1
1
SR0
0
1
0
1
传播范围
± 1.50%
± 2.50%
± 0.50%
± 1.00%
调制速率
(F
IN
/ 80） * 34.72千赫
(F
IN
/ 80） * 34.72千赫
(F
IN
/ 80） * 34.72千赫
(F
IN
/ 80） * 34.72千赫
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PULSECORE [ PulseCore Semiconductor ]
