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PCS2I99446G-32-ER 参数 Datasheet PDF下载

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型号: PCS2I99446G-32-ER
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内容描述: 2.5V和3.3V LVCMOS时钟分配缓冲区 [2.5V and 3.3V LVCMOS Clock Distribution Buffer]
分类和应用: 时钟驱动器逻辑集成电路
文件页数/大小: 14 页 / 573 K
品牌: PULSECORE [ PulseCore Semiconductor ]
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2006年9月
修订版0.5
表7 :交流特性
(V
CC
= V
CCA
= V
建行
= V
CCC
= 3.3V ±5% ,T
A
= -40 ° C至+ 85°C )
1
符号
f
REF
f
最大
t
P
,
REF
t
r
, t
f
t
PLH
t
PHL
t
PLZ , HZ
t
PZL , LZ
t
SK ( O)
t
SK (PP)的
t
SK (p)的
DC
Q
t
r
, t
f
输入频率
最大输出频率
参考输入脉冲宽度
CCLK输入上升/下降时间
传播延迟
输出禁止时间
输出使能时间
输出至输出
SKEW
设备到设备斜
输出脉冲偏斜
4
输出占空比
输出上升/下降时间
÷ 1输出
÷ 2输出
47
45
0.1
50
50
在一家银行
任何输出银行,同
输出分频器
任何输出,所有输出分频器
CCLK0,1任何Q
CCLK0,1任何Q
2.2
2.2
2.8
2.8
÷ 1输出
÷ 2输出
PCS2I99446
特征
0
0
0
1.4
典型值
最大
250
2
单位
兆赫
兆赫
兆赫
nS
nS
nS
nS
nS
nS
pS
pS
pS
nS
pS
%
%
nS
条件
FSELx=0
FSELx=1
0.8〜 2.0V
250
2
125
1.0
4.45
4.2
10
10
150
200
350
2.25
200
53
55
1.0
3
DC
REF
= 50%
DC
REF
= 25%-75%
0.55〜 2.4V
注: 1 AC特点,适用于50Ω到V并行输出端接
TT
2 PCS2I99446是官能高达350MHz的的输入和输出时钟频率,并且其特征在于高达250MHz 。
3冲突的1.0nS最大输入上升和下降时间的限制会影响器件的传播延迟,设备到设备歪斜,参考输入脉冲宽度
输出占空比和最大频率的规格。
4输出脉冲偏斜的传播延迟时间的绝对差|吨
PLH
- t
PHL
|.
表8 :直流特性
(V
CC
= V
CCA
= V
建行
= V
CCC
= 2.5V ±5% ,T
A
= -40 ° C至+ 85°C )
符号
V
IH
V
IL
V
OH
V
OL
Z
OUT
I
IN
I
CCQ
3
特征
输入高电压
输入低电压
输出高电压
输出低电压
输出阻抗
输入电流
最大静态电源电流
2
1.7
-0.3
1.8
典型值
最大
V
CC
+ 0.3
0.7
0.6
单位
V
V
V
V
µA
mA
条件
LVCMOS
LVCMOS
I
OH
= -15毫安
1
I
OL
= 15毫安
V
IN
= GND或V
IN
=V
CC
所有V
CC
引脚
17 - 20
2
±200
2.0
注: 1 PCS2I99446可驱动50Ω的
在入射边的传输线。每路输出驱动器1 50Ω
并行端接的传输线,以
V的终止电压
TT
。或者,装置可驱动多达2 50Ω
系列终止每个输出传输线。
2输入上拉/下拉电阻影响的输入电流。
3 I
CCQ
是设备与所有输出打开,输入在默认状态下或打开的DC电流消耗。
2.5V和3.3V LVCMOS时钟分配缓冲区
注意:本文档中的信息如有更改,恕不另行通知。
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