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型号: PCS5I9775
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内容描述: 2.5V或3.3V , 200MHz的, 14输出零延迟缓冲器 [2.5V or 3.3V, 200MHz, 14 Output Zero Delay Buffer]
分类和应用:
文件页数/大小: 12 页 / 503 K
品牌: PULSECORE [ PulseCore Semiconductor ]
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2006年9月
修订版0.4
2.5V或3.3V , 200MHz的, 14输出零延迟缓冲器
一般特点
输出频率范围: 8.3MHz至200MHz
输入频率范围: 4.2MHz至125MHz的
2.5V或3.3V操作
拆分2.5V / 3.3V输出
14时钟输出:驱动多达28时钟线
1反馈时钟输出
2 LVCMOS的参考时钟输入
150PS的最大输出,输出偏斜
PLL旁路模式
“ SpreadTrak ”
输出使能/禁用
工业温度范围: -40 ° C至+ 85°C
52引脚1.0毫米TQFP封装
符合RoHS标准
PCS5I9775
提供了在3银行5,5 ,和4 14输出分配
输出。 A银行和B银行的4分VCO输出
或8 ,而C银行除以8或12% SEL (A :C )
设置,请参见
功能表。
这些分频器允许
输出至6输入的比率:1,4 :1,3 :1,2 :1,3 : 2,4: 3,1: 1 ,
和2:3。每个LVCMOS兼容的输出可以驱动50Ω
串联或并联端接的传输线。对于系列
端接传输线,每个输出可以驱动一个
或两条迹线给出了装置的1点28分的有效的扇出。
PLL被确保稳定的,因为压控振荡器是
配置到200MHz至500MHz之间运行。这
允许一个宽范围的输出频率从8.3MHz到
为200MHz 。对于正常操作,外部反馈
输入, FB_IN ,被连接到所述反馈输出,
Fb_out分别。内部VCO是在的倍数运行
输入参考时钟进行反馈分压器设置,请参见
频率表。
当PLL_EN为低, PLL是
旁路和参考时钟直接提供
输出分频器。这个模式是完全静态的和最小
输入时钟频率规范并不适用。
功能说明
该PCS5I9775是低电压高性能
200MHz的基于PLL的设计,零延迟缓冲器
快速
时钟
分配
应用程序。
PCS5I9775有两个参考时钟输入,
框图
.
VCO_SEL (1,0 )
PLL_EN
TCLK_SEL
TCLK0
TCLK1
FB_IN
拉美经济体系
÷2/÷4
CLK
停止
÷2
PLL
200-
500MHZ
÷2/÷4
÷4
CLK
停止
QA0
QA1
QA2
QA3
QA4
QB0
QB1
QB2
QB3
QB4
SELB
÷4/÷6
SELC
CLK_STP #
CLK
停止
QC0
QC1
QC2
QC3
Fb_out分别
÷4/÷6/÷8/÷12
FB_SEL(1.0)
MR# / OE
PulseCore半导体公司
1715 S.巴斯科姆大道套房200 ,坎贝尔,CA 95008
联系电话: 408-879-9077
传真: 408-879-9018
www.pulsecoresemi.com
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