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PCS5I9775 参数 Datasheet PDF下载

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型号: PCS5I9775
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内容描述: 2.5V或3.3V , 200MHz的, 14输出零延迟缓冲器 [2.5V or 3.3V, 200MHz, 14 Output Zero Delay Buffer]
分类和应用:
文件页数/大小: 12 页 / 503 K
品牌: PULSECORE [ PulseCore Semiconductor ]
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2006年9月
修订版0.4
AC电气规格
6
(
VDD = 3.3V ± 5 % ,T
A
= -40 ° C至+ 85°C )
参数
描述
条件
f
VCO
VCO频率
÷ 4反馈
÷ 6反馈
÷ 8反馈
÷ 12反馈
f
in
输入频率
÷ 16反馈
÷ 24反馈
÷ 32反馈
÷ 48反馈
旁路模式
( PLL_EN = 0)
f
refDC
t
r
, t
f
输入占空比
TCLK输入上升/下降时间
0.8V至2.0V
÷ 2输出
÷ 4输出
÷ 6输出
f
最大
最大输出频率
÷ 8输出
÷ 12输出
÷ 16输出
÷ 24输出
DC
t
r
, t
f
t
(φ)
t
SK ( O)
输出占空比
输出上升/下降时间
传播延迟(静态相
偏移量)
输出至输出扭曲
0.8V至2.4V
TCLK到FB_IN ,同
VDD时,不包括
抖动
内银歪斜
银行在相同的电压,
同频
银行在相同的电压,
不同的频率
银行在不同
电压
PCS5I9775
200
50
33.3
25
16.7
12.5
8.3
6.3
4.2
0
25
-
100
50
33.3
25
16.7
12.5
8.3
45
0.1
-100
典型值
最大
500
125
83.3
62.5
41.6
31.3
20.8
15.6
10.4
200
75
1.0
200
125
83.3
62.5
41.6
31.3
20.8
55
1.0
100
150
150
225
250
10
10
单位
兆赫
兆赫
%
nS
兆赫
%
nS
pS
pS
t
SK ( B)
银行对银行斜
pS
t
PLZ , HZ
t
PZL ,ZH
BW
t
JIT ( CC )
t
JIT ( PER )
t
JIT ( φ )
t
LOCK
输出禁止时间
输出使能时间
PLL的闭环带宽( -3dB )
周期到周期抖动
周期抖动
I / O的相位抖动
最大PLL锁定时间
I / O在同一VDD
VCO_SEL = 0
VCO_SEL = 1
同频
多频
0.5 - 1.0
1.0 - 2.0
nS
nS
兆赫
150
300
100
150
1
pS
pS
pS
mS
2.5V或3.3V , 200MHz的, 14输出零延迟缓冲器
注意:本文档中的信息如有更改,恕不另行通知。
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