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P1753-30QGMB 参数 Datasheet PDF下载

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型号: P1753-30QGMB
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内容描述: 单芯片的40MHz CMOS MMU / COMBO [SINGLE CHIP, 40MHz CMOS MMU/COMBO]
分类和应用: 内存管理单元微控制器和处理器外围集成电路时钟
文件页数/大小: 21 页 / 187 K
品牌: PYRAMID [ PYRAMID SEMICONDUCTOR CORPORATION ]
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PACE1753
单芯片的40MHz
CMOS MMU / COMBO
特点
实现了MIL -STD- 1750A指令集
架构内存管理和
保护高达1 Megaword 。所有的映射
存储器( 10240比特)同时为MMU和
BPU功能都包含在芯片上。
设计,接口存储器的
PACE1750A / AE 16位, 40 MHz处理器。
系统可设计在不等待
态,需要多达40兆赫的时钟速率
使用这些PACE产品时。
系统性能和设备的数量是
与PACE1754使用时优化
处理器接口电路(PIC) 。
提供以下附加功能:
- EDAC ,错误检测和纠正,或
奇偶产生和检测
- 正确的数据寄存器,用于诊断
- 第一个内存故障地址寄存器
- 非法地址错误检测 -
可编程
- 多主机仲裁
8位扩展地址锁存器和驱动器上
芯片
信息总线和片上EDAC收发器
在20军, 30和40 MHz运行
温度范围
单5V ± 10 %电源
功耗比军用温度
范围(P
D
输出OPEN )
< 0.20瓦特在20 MHz时
< 0.30瓦特在30MHz
< 0.40瓦特在40兆赫
可用:
- 64引脚DIP或鸥翼( 50英里引脚中心)
- 68引脚引脚栅格阵列( PGA ) ( 100英里中心)
- 68引脚四方包(有引线芯片载体)
内存管理单元和
块保护单位“二合一” -
功能说明
该PACE1753 ( COMBO )是一个支持芯片的
PACE1750A / AE微处理器系列。它提供了
下面的支撑功能的系统:
1.内存管理和接入保护
到1M的话。
长达1兆字2物理存储器的写保护
记忆中的每1K字的页面。另
提供了一种用于在CPU和用于DMA中的保护
系统,其中包括DMA中。
3.检测非法L / O访问(通过MIL-定义
STD- 1750A ) ,或访问一个未实现的块
的存储器。在每一种情况下会产生一个错误标志
到处理器。
4检测数据总线上的双重错误,
修正一个错误。会产生一个错误信号
到处理器时,在检测到多个错误。
5. RDYA产生。多达3个等待状态可以是
通过生成插入到总线的地址相
未就绪, RDYA低信号。等待数
所需的状态可以在内部进行编程
注册的COMBO 。
6.总线仲裁长达4主人。仲裁
上固定的优先级的基础上完成(即通过互连
硬件) 。 (在68引脚封装) 。
文档#
MICRO-4
修订版D
修订后的2005年11月