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SI3452D-B01-GM 参数 Datasheet PDF下载

SI3452D-B01-GM图片预览
型号: SI3452D-B01-GM
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内容描述: QUAD HIGH- VOLTAGE端口控制器为PoE和PoE + PSES [QUAD HIGH-VOLTAGE PORT CONTROLLER FOR POE AND POE+ PSES]
分类和应用: 模拟IC信号电路控制器
文件页数/大小: 36 页 / 308 K
品牌: SILABS [ SILICON LABORATORIES ]
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Si3452/3
表11. SMBus的(我
2
C)时序规范(参见图1)
VDD = 3.0〜 3.6 V
描述
串行总线时钟频率
SCL高电平时间
SCL为低电平的时间
SCL , SDA上升时间
SCL , SDA下降时间
总线空闲时间
开始保持时间
启动安装程序时
停止建立时间
数据保持时间
数据建立时间
从硬件还是软的时间
洁具重置,直到我开始
2
C
TRAF科幻ç
从事件到INT引脚延时
低或清晰的阅读到
INT引脚为高电平
符号
f
SCL
t
圣公会
t
SKL
t
R_SCL
t
F_SCL
t
BUF
t
某事
t
STS
t
SPS
t
DH
t
DS
t
RESET
测试条件
0
600
1.3
20
20
典型值
最大
400
300
150
100
单位
千赫
ns
μs
ns
ns
μs
ns
ns
ns
ns
ns
ms
启动和停止间
条件。
之间的START和第一低SCL 。
与SCL为高电平,并启动
条件。
与SCL高, STOP
条件。
1.3
600
600
600
200
200
复位启动条件
t
INT
5
ms
注意事项:
1.
未经过生产测试(通过设计保证) 。
2.
在V测量所有时序参考
IL
和V
IH
.
3.
在的Si3452 / 3将延伸如果需要在ACK时间段(拉下) SCK 。最大拉伸SCL为
10微秒;所以, SCL仅需要是双向的,因为我
2
C总线速度超过50千赫。
f
SC L
t
R_SCL
t
F_SC L
t
圣公会
t
SKL
SCL
t
BU ˚F
t
ST ħ
t
DS
t
深高
t
SPS
SDA
D7
D6
D5
D4
D3
D0
开始位
停止位
图1.我
2
Ç时序图
1.0版
9