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Si5326
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描述
该Si5326是一个抖动衰减精密时钟乘法器
应用程序需要分1 ps的抖动性能。该Si5326
接受双时钟输入从2 kHz至710 MHz和
产生两个输出时钟，从2 kHz至945 MHz的
并选择频率为1.4 GHz 。两个输出端都
从共同源极分别分割下来。该装置
提供几乎任何频率变换组合
在整个这个操作范围。该Si5326时钟输入
频率和时钟倍频比可编程
通过I
2
C或SPI接口。该Si5326是基于
Silicon Laboratories的第三代DSPLL
®
技术，
它提供任意速率频率合成和抖动
衰减在一个高度集成的PLL解决方案，消除
需要外部VCXO和环路滤波器元件。该
DSPLL环路带宽数字可编程，提供
在应用程序级别的抖动性能优化。
从一个单一的1.8 ， 2.5或3.3 V电源供电， Si5326
是理想的提供时钟倍频和抖动衰减
在高性能定时应用。
特点
生成从2kHz任何频率945兆赫
并选择频率为1.4 GHz的从输入
2千赫至710兆赫的频率
超低抖动时钟输出瓦特/抖动产生的
低至0.3 ps的均方根（ 50 kHz至80 MHz的）
具有可选的环路带宽集成环路滤波器
（ 60 Hz至8.4 kHz时）
满足OC- 192 GR- 253 -CORE抖动规范
双时钟输入W /手动或自动
控制的无中断切换
具有可选的信号格式双时钟输出
（ LVPECL ， LVDS ， CML ， CMOS ）
支持ITU G.709和自定义FEC比率
(255/238, 255/237, 255/236)
LOL ， LOS ， FOS报警输出
数字控制输出相位调整
I
2
C或SPI可编程
片上稳压器为1.8 ， 2.5或3.3 V
±10％的操作
小尺寸： 6 ×6mm的36引脚QFN
无铅，符合RoHS标准
应用
SONET / SDH OC- 48 / OC -192线卡
千兆/万兆以太网， 1/2/ 4/8 / 10GFC线卡
ITU G.709和自定义FEC线卡
光模块
无线基站
数据转换器时钟
xDSL的
SONET / SDH + PDH时钟合成
测试与测量
XTAL或参考时钟，
CKIN1
÷ N31
÷ NC1
CKOUT1
®
CKIN2
÷ N32
DSPLL
÷ NC2
÷ N2
信号丢失/
频率偏移
锁定丢失
CKOUT2
信号检测
控制
VDD （ 1.8 ， 2.5或3.3 V ）
GND
I
2
C / SPI端口
设备中断
速率选择
时钟选择
延迟控制
机密版本0.2 2/07
版权所有©2007 Silicon Laboratories公司
Si5326
此信息适用于正在研发的产品。其特点和规格如有变更，恕不另行通知。
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