CY2SSTV857-32
差分时钟缓冲器/驱动器DDR400 / PC3200兼容
特点
•工作频率： 60 MHz至230 MHz的
•支持400 MHz的DDR SDRAM
•从一个差分输入10差分输出
•扩频兼容
•低抖动（周期到周期） ： < 75
•极低的偏移： < PS 100
•电源管理控制输入
•高阻抗输出时输入时钟< 20兆赫
• 2.6V操作
•与CDC857-2和-3引脚兼容
• 48引脚TSSOP和40 QFN封装
• -40 °C工业温度85°C
•符合JEDEC DDR规格
描述
该CY2SSTV857-32是一款高性能，低偏移，
低抖动零延迟缓冲器设计为分配差
时钟在高速应用。该CY2SSTV857-32
产生10差分对时钟输出从一个differ-
无穷区间对时钟输入。此外， CY2SSTV857-32
具有差分反馈时钟outpts和投入。这
允许CY2SSTV857-32被用作零延迟缓冲器。
当在嵌套的时钟树用作零延迟缓冲器，所述
CY2SSTV857-32锁定到输入参考，并转化
接近零延迟低偏移输出。
框图
3
2
引脚配置
VS S
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
VS S
Y5 #
Y5
VD ð Q
Y6
Y6 #
VS S
VS S
Y7 #
Y7
VD ð Q
PD ＃
在FB
在FB ＃
VD ð Q
FB Ø ü T＃
FB O u那样牛逼
VS S
Y8 #
Y8
VD ð Q
Y9
Y9 #
VS S
PD
37
AVDD
16
试验
断电
逻辑
5
6
10
9
20
19
22
23
46
47
44
43
Y0
Y0#
Y1
Y1#
Y2
Y2#
Y3
Y3#
Y4
Y4#
Y5
Y5#
Y6
Y6#
Y7
Y7#
Y8
Y8#
Y9
Y9#
FBOUT
FBOUT ＃
Y0 #
Y0
VD ð Q
Y1
Y1 #
VS S
VS S
Y2 #
Y2
VD ð Q
VD ð Q
CLK
Ç LK ＃
VD ð Q
AVD ð
的AV s
VS S
Y3 #
Y3
VD ð Q
Y4
Y4 #
VS S
CY2SSTV857-32
CLK
CLK ＃
FBIN
FBIN ＃
13
14
36
35
39
40
PLL
29
30
27
26
32
33
1.0版， 2006年11月21日
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