12-BIT
µ
p兼容
模拟 - 数字转换器
TC7109
TC7109A
握手模式
接口的TC7109A以另一种方式
数字系统提供了当握手输出
在TC7109A的模式变为主动的控制
流动的被动地响应于芯片的数据，而不是与
字节使能输入。该模式允许直接接口
在TC7109A和行业标准的UART之间
没有任何外部逻辑要求。 TC7109A提供所有
必要的控制和信号旗测序两
数据到UART的字节，并启动其传输
以串行方式时，触发进入握手模式。
设计远程数据采集站的成本是
采用串行数据传输，以减少对降低
线向中央控制处理器的数目。
MODE输入控制信号交换模式。当
MODE输入保持高电平时， TC7109A进入
后的新数据的握手方式已被存储在所述
输出锁存器在每次转换结束时进行
（见图7和8）。进入握手模式可
由MODE输入需求来触发。随时
在转换周期的低到高的转变
短脉冲的输入方式会导致立即进入
进入握手模式。如果出现这种脉冲而新的
数据被存储时，进入握手模式是
延迟直到该数据是稳定的。 MODE输入被忽略
在握手模式，直到转换完成
输出周期和清除信号交换方式，数据
更新将被禁止（见图9） 。
当MODE输入为HIGH时，或当转换器
进入握手模式下，芯片和字节使能
输入成为TTL兼容的输出可提供的
输出的周期控制信号（参见图7，图8和图9 ） 。
在SEND输入所使用的转换器作为指示灯
的接收装置的能力和灰（如UART ）
接受在握手模式数据。的序列
输出循环使用SEND保持高电平，如图
7.握手模式（内部模式高）进入
数据锁存脉冲（在CE / LOAD ， LBEN和HBEN后
终端被激活为输出模式以来保持高电平） 。
在发送输入的高电平检测到的
同样的高到低的内部时钟边沿。在下一LOW-
到高的内部时钟边沿，高阶字节（位9
通过12 ， POL和OR）输出使能且CE /
负荷和HBEN输出假定一个低电平。该
CE / LOAD输出保持低电平为一个完整的内部时钟
只期;数据输出保持活跃1-1 / 2接口
内部时钟周期;与高字节使能保持低
2个时钟周期。在CE / LOAD输出低电平或
低到高的边缘可被用作同步显
最终，以确保有效的数据，和字节使能为输出
可以用作一个字节识别标志。随着SEND
居高不下的转换完成输出循环
使用CE / LOAD和LBEN而低位字节输出
看跌期权（位1至8）被激活。当两个字节
发送时，信号交换方式被终止。典型的UART
接口时序示于图8中的SEND输入是
用于延迟的序列，或握手的部分，以
保证正确的数据传输。此时序图显示了一个
行业标准的HD6403或CDP1854 CMOS UART来
接口为串行数据通道。该输入发送到
TC7109A由TBRE （发送缓冲区雷吉斯驱动
之三空）输出的UART ，以及在CE / LOAD输入
在TC7109A驱动TBRL （发送缓冲寄存器
负载）输入到UART 。这八个发送缓冲寄存器
器输入可接收并行数据输出。与UART
发送缓冲寄存器空，发送输入会
高电平时握手模式后，新的数据进入
被存储。高位字节输出变得活跃，
在CE / LOAD和HBEN输入将变低后， SEND是
检测。当CE / LOAD变为高电平，在一方的端
时钟周期，高位字节的数据读入
UART发送缓冲寄存器。 UART的TBRE输出
将变低，从而停止输出周期与HBEN
产量低，高位字节输出有效。当
在UART已传送的数据传送到发送器寄存器
之三和清除发送缓冲寄存器， TBRE
返回高电平。高位字节输出禁用
接下来的TC7109A内部时钟HIGH到LOW边缘，
二分之一的内部时钟后， HBEN输出返回高。
在CE / LOAD和LBEN输出变为低电平的同时
时间作为低位字节的输出变为活动状态。当
在CE / LOAD返回高电平，在一个时钟周期结束时，
低位的数据移入UART发送器
缓冲寄存器， TBRE再次变低。下一个
TC7109A内部时钟高电平到低电平的边缘会感觉到
当TBRE返回到高电平时，禁止数据的输入。
二分之一的内部时钟后，握手模式被清除，
和CE / LOAD ， HBEN和LBEN终端返回
高和保持活跃，如果模式仍然很高。
握手输出顺序，可以执行上
通过触发转换器进入握手模式的需求
与MODE输入一个低到高的边缘。一个手工
摇触发输出序列示于图9中。
SEND输入为低电平时，转换器进入握手
模式。整个输出序列由控制
SEND输入，并且该序列的第（高位）字节
类似的序列的第二个字节。
图9还示出了输出序列可以采取
比一个转换周期更长。新的数据将不会被锁定
当握手模式仍在进行中和是there-
前丢失。
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