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WED3DG72126V7D2 参数 Datasheet PDF下载

WED3DG72126V7D2图片预览
型号: WED3DG72126V7D2
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内容描述: 1 GB- 128Mx72 , SDRAM UNBUFFERED [1 GB-128Mx72, SDRAM UNBUFFERED]
分类和应用: 存储内存集成电路动态存储器时钟
文件页数/大小: 5 页 / 454 K
品牌: WEDC [ WHITE ELECTRONIC DESIGNS CORPORATION ]
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WED3DG72126V-D2
1GB - 128Mx72 , SDRAM UNBUFFERED
特点
n
突发模式工作
n
自动和自刷新功能
n
LVTTL兼容的输入和输出
n
串行存在检测与EEPROM
n
完全同步:所有信号记录在正
在系统时钟的边沿
n
可编程突发长度: 1 , 2 , 4 , 8或整页
n
3.3伏
6
0.3V电源
n
168-引脚DIMM的JEDEC
*
*先进
描述
该WED3DG72126V是作为一个128Mx72同步
DRAM模块,它由18 64Mx8 SDRAM堆叠
在TSOP- 11包,和一个2K EEPROM元件在8
检测其安装引脚TSSOP封装的串行设备
在一个168引脚DIMM多层FR4基板上。
数据资料描述了一种产品,它可能是也可能不是正在开发
并且可随时更改或取消,恕不另行通知。
引脚配置(正面/背面)
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
VSS
DQ0
DQ1
DQ2
DQ3
VDD
DQ4
DQ5
DQ6
DQ7
DQ8
VSS
DQ9
DQ10
DQ11
DQ12
DQ13
VDD
DQ14
DQ15
CB0
CB1
VSS
NC
NC
VDD
WE
DQM0
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
DQM1
CS0
DNU
VSS
A0
A2
A4
A6
A8
A10/AP
BA1
VDD
VDD
CLK0
VSS
DNU
CS2
DQM2
DQM3
DNU
VDD
NC
NC
CB2
CB3
VSS
DQ16
DQ17
57
58
59
60
61
62
63
64
65
66
67
68
69
70
71
72
73
74
75
76
77
78
79
80
81
82
83
84
DQ18
DQ19
VDD
DQ20
NC
* VREF
CKE1
VSS
DQ21
DQ22
DQ23
VSS
DQ24
DQ25
DQ26
DQ27
VDD
DQ28
DQ29
DQ30
DQ31
VSS
CLK2
NC
NC
** SDA
** SCL
VDD
85
86
87
88
89
90
91
92
93
94
95
96
97
98
99
100
101
102
103
104
105
106
107
108
109
110
111
112
VSS
DQ32
DQ33
DQ34
DQ35
VDD
DQ36
DQ37
DQ38
DQ39
DQ40
VSS
DQ41
DQ42
DQ43
DQ44
DQ45
VDD
DQ46
DQ47
CB4
CB5
VSS
NC
NC
VDD
CAS
DQM4
113
114
115
116
117
118
119
120
121
122
123
124
125
126
127
128
129
130
131
132
133
134
135
136
137
138
139
140
DQM5
CS1
RAS
VSS
A1
A3
A5
A7
A9
BA0
A11
VDD
CLK1
A12
VSS
CKE0
CS3
DQM6
DQM7
*A13
VDD
NC
NC
CB6
CB7
VSS
DQ48
DQ49
141
142
143
144
145
146
147
148
149
150
151
152
153
154
155
156
157
158
159
160
161
162
163
164
165
166
167
168
DQ50
DQ51
VDD
DQ52
NC
* VREF
NC
VSS
DQ53
DQ54
DQ55
VSS
DQ56
DQ57
DQ58
DQ59
VDD
DQ60
DQ61
DQ62
DQ63
VSS
CLK3
NC
**SA0
**SA1
**SA2
VDD
引脚名称
A0 – A12
BA0-1
DQ0-63
CB0-7
CLK0-CLK3
CKE0,CKE1
CS0-CS3
RAS
CAS
WE
DQM0-7
VDD
VSS
* VREF
SDA
SCL
SA0-2
DNU
NC
地址输入(复用)
选择银行
数据输入/输出
校验位(数据输入/数据输出)
时钟输入
时钟使能输入
片选输入
行地址选通
列地址选通
写使能
DQM
电源( 3.3V )
电源为参考
串行数据I / O
串行时钟
地址在EEPROM
不要使用
无连接
*这些引脚没有这个模块中使用。
**这些引脚应在数控系统里面
不支持SPD 。
怀特电子设计公司• ( 508 ) 366-5151 •www.whiteedc.com
2
2002年3月修订版A
ECO #XXXXX