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WM8766EDSRV 参数 Datasheet PDF下载

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型号: WM8766EDSRV
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内容描述: 24位192KHZ 6通道DAC [24 BIT 192KHZ 6 CHANNEL DAC]
分类和应用:
文件页数/大小: 32 页 / 327 K
品牌: WOLFSON [ WOLFSON MICROELECTRONICS PLC ]
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初步的技术数据
注意事项:
1.
2.
用1kHz的满量程输入输出水平,与所有零到数字输入,输出电平之比,衡量'A'
加权。
WM8766
所有的性能测量结果进行以20kHz的低通滤波器,并且其中指出的A-权重滤波器。未使用
这种滤波器将导致更高的THD + N和较低的信噪比和动态范围的读数比被发现在电
的特点。低通滤波器去除带外噪声;虽然它不是可听它可能会影响到动态
规范值。
VMID解耦与10uF至0.1uF的电容(较小的值可能会导致性能下降) 。
3.
术语
1.
2.
信噪比(分贝) - SNR是满量程输出与输出之间的高度差的测量值
没有信号应用。 (没有自动归零或自动静音功能被用在实现这些结果)。
动态范围(分贝) - 红霉素是一种信号的最高和最低部分之间的差异的量度。
低于满量程通常, THD + N测量的60分贝。所测量的信号然后通过添加60分贝校正
给它。 (如THD + N = -60dB -32dB , DR = 92分贝) 。
THD + N(分贝) - THD + N为(噪声+失真) /信号的比值的均方根值。
停带衰减(dB ) - 是向其中频谱被衰减的程度(外音频带)。
声道分离度(DB ) - 也称为串扰。这是一个信道是从分离的量的量度
另一个。通过发送一个满刻度信号向下一个信道并测量其它正常测量。
通带纹波 - 在通带区域的频率响应的任何变化。
3.
4.
5.
6.
主时钟时序
t
MCLKL
MCLK
t
MCLKH
t
MCLKY
图1 DAC主时钟时序要求
测试条件
AVDD , VREFP = 5V , DVDD = 3.3V , AGND , VREFN = 0V , DGND = 0V ,T
A
= +25
o
C, FS = 48kHz的, MCLK = 256fs除非
另有说明。
参数
系统时钟时序信息
MCLK系统时钟脉冲宽度
MCLK系统时钟脉冲宽度
MCLK系统时钟周期时间
MCLK占空比
表1主时钟时序要求
t
MCLKH
t
MCLKL
t
MCLKY
11
11
28
40:60
60:40
ns
ns
ns
符号
测试条件
典型值
最大
单位
w
工信部版本2.3 2004年2月
7