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ZL30123GGG 参数 Datasheet PDF下载

ZL30123GGG图片预览
型号: ZL30123GGG
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内容描述: 低抖动线路卡同步器 [Low Jitter Line Card Synchronizer]
分类和应用:
文件页数/大小: 27 页 / 328 K
品牌: ZARLINK [ ZARLINK SEMICONDUCTOR INC ]
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ZL30123
SONET / SDH的
低抖动线路卡同步器
数据表
2006年5月
一个完整的设计手册是提供给符合条件的客户。
To
注册,
发送
an
电子邮件
to
TimingandSync@Zarlink.com 。
订购信息
ZL30123GGG
100针CABGA
托盘
ZL30123GGG2 100引脚CABGA *
托盘
*无铅锡/银/铜
-40
o
C至+ 85
o
C
DPLL2提供了全面的功能集
用于生成派生的输出时钟等
通用时钟
提供了支持8时钟参考输入
频率为8千赫到任意倍数
77.76兆赫除了2千赫
提供3个输出的帧同步脉冲输入
校准
产生几种风格的输出帧脉冲
具有可选的脉冲宽度,极性和频率
可配置的输入到输出的延迟,并输出到
输出相位对齐
灵活的输入参考自动监测
无权担任基于频率参考和
相违规
支持IEEE 1149.1 JTAG边界扫描
特点
同步标准电信系统
引用并合成各种各样的
保护电信线路接口的时钟是
符合Telcordia的GR- 253 -CORE和ITU -T
G.813
内部APLL提供标准输出时钟
频率高达622.08 MHz的抖动< PS 3
RMS适用于GR- 253 -CORE OC -12和G.813
STM-16接口
可编程输出频率合成器( P0 , P1 )
从任何生成多个时钟频率
8 kHz到77.76兆赫,除了2千赫
提供了两个的DPLL这分别是
通过一个串行外设接口配置
DPLL1提供了所有必要的功能
产生SONET / SDH兼容的时钟,包括
自动无中断参考切换,自动
模式选择(锁定,自由运行,缓缴) ,和
可选择的环路带宽
trst_b TCK TDI TMS
TDO
dpll2_ref
dpll1_hs_en
dpll1_lock dpll1_holdover
diff0_en
diff1_en
OSCO
OSCI
时钟
IEEE 1449.1
JTAG
REF
DPLL2
P0
合成
P1
合成
p0_clk0
p0_clk1
p0_fp0
p0_fp1
p1_clk0
p1_clk1
diff0
diff1
ref0
ref1
ref2
ref3
ref4
ref5
ref6
ref7
sync0
sync1
sync2
ref7 : 0
REF
DPLL1
SYNC2 : 0
参考
MONITORS
ref_&_sync_status
SYNC
fb_clk / FP
SONET / SDH的
APLL
sdh_clk0
sdh_clk1
sdh_fp0
sdh_fp1
FB_CLK
反馈
合成
INT_B
SPI接口
控制器&
状态机
SCK
si
so
CS_B
RST_B
dpll1_mod_sel1 : 0
sdh_filter
filter_ref0
filter_ref1
图1 - 框图
1
卓联半导体公司
卓联, ZL和卓联半导体公司标识是卓联半导体公司的商标。
版权所有2006年,卓联半导体公司保留所有权利。