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  • 深圳市力拓辉电子有限公司

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  • 深圳市芯脉实业有限公司

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  • 深圳市捷立辉科技有限公司

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产品型号74HC138的概述

1. 芯片74HC138概述 74HC138是一个著名的3-8译码器/解码器,在数字电路中广泛应用。其功能是将三位二进制输入信号转换为对应的八个输出线中的一个变为低电平(有效),同时其他输出保持高电平。这种特性使得7HC138非常适合用于地址解码、存储器选择和数据选择等多种应用。 2. 芯片74HC138的详细参数 74HC138的参数主要涉及电气特性、功能特性和输入输出特性等。以下是74HC138的一些关键参数: - 电源电压 (VCC): 2V 到 6V(通常为 5V) - 工作电压范围: 2.0V 到 6.0V - 输入高电平阈值 (VIH): 3.5V (在5V电源情况下) - 输入低电平阈值 (VIL): 1.5V (在5V电源情况下) - 输出高电平电压 (VOH): ≥ 4.5V (在5V电源条件下) - 输出低电平电压 (VOL): ≤ 0.5V (在5V电源条件下) ...

产品型号74HC138的Datasheet PDF文件预览

INTEGRATED CIRCUITS  
DATA SHEET  
For a complete data sheet, please also download:  
The IC06 74HC/HCT/HCU/HCMOS Logic Family Specifications  
The IC06 74HC/HCT/HCU/HCMOS Logic Package Information  
The IC06 74HC/HCT/HCU/HCMOS Logic Package Outlines  
74HC/HCT138  
3-to-8 line decoder/demultiplexer;  
inverting  
September 1993  
Product specification  
File under Integrated Circuits, IC06  
Philips Semiconductors  
Product specification  
3-to-8 line decoder/demultiplexer; inverting  
74HC/HCT138  
The 74HC/HCT138 decoders accept three binary  
FEATURES  
weighted address inputs (A0, A1, A2) and when enabled,  
provide 8 mutually exclusive active LOW outputs (Y0 to  
Y7).  
Demultiplexing capability  
Multiple input enable for easy expansion  
Ideal for memory chip select decoding  
Active LOW mutually exclusive outputs  
Output capability: standard  
ICC category: MSI  
The “138” features three enable inputs: two active LOW  
(E1 and E2) and one active HIGH (E3). Every output will be  
HIGH unless E1 and E2 are LOW and E3 is HIGH.  
This multiple enable function allows easy parallel  
expansion of the “138” to a 1-of-32 (5 lines to 32 lines)  
decoder with just four “138” ICs and one inverter.  
The ”138” can be used as an eight output demultiplexer by  
using one of the active LOW enable inputs as the data  
input and the remaining enable inputs as strobes. Unused  
enable inputs must be permanently tied to their  
appropriate active HIGH or LOW state.  
GENERAL DESCRIPTION  
The 74HC/HCT138 are high-speed Si-gate CMOS devices  
and are pin compatible with low power Schottky TTL  
(LSTTL). They are specified in compliance with JEDEC  
standard no. 7A.  
The ”138” is identical to the “238” but has inverting outputs.  
QUICK REFERENCE DATA  
GND = 0 V; Tamb = 25 °C; tr = tf = 6 ns  
TYPICAL  
SYMBOL  
PARAMETER  
propagation delay  
CONDITIONS  
UNIT  
HC  
HCT  
CL = 15 pF; VCC = 5 V  
t
PHL/ tPLH  
An to Yn  
12  
14  
17  
19  
ns  
ns  
tPHL/ tPLH  
E3 to Yn  
En to Yn  
CI  
input capacitance  
3.5  
67  
3.5  
67  
pF  
pF  
CPD  
power dissipation capacitance per package notes 1 and 2  
Notes  
1. CPD is used to determine the dynamic power dissipation (PD in µW):  
PD = CPD × VCC2 × fi + ∑ (CL × VCC2 × fo) where:  
fi = input frequency in MHz  
fo = output frequency in MHz  
(CL × VCC2 × fo) = sum of outputs  
CL = output load capacitance in pF  
VCC = supply voltage in V  
2. For HC the condition is VI = GND to VCC  
For HCT the condition is VI = GND to VCC 1.5 V  
ORDERING INFORMATION  
See “74HC/HCT/HCU/HCMOS Logic Package Information”.  
September 1993  
2
Philips Semiconductors  
Product specification  
3-to-8 line decoder/demultiplexer; inverting  
74HC/HCT138  
PIN DESCRIPTION  
PIN NO.  
SYMBOL  
A0 to A2  
E1, E2  
E3  
NAME AND FUNCTION  
1, 2, 3  
address inputs  
4, 5  
enable inputs (active LOW)  
enable input (active HIGH)  
ground (0 V)  
6
8
GND  
15, 14, 13, 12, 11, 10, 9, 7  
16  
Y0 to Y7  
VCC  
outputs (active LOW)  
positive supply voltage  
handbook, halfpage  
1
A
Y
Y
Y
Y
Y
Y
Y
Y
15  
14  
13  
12  
11  
10  
9
0
1
2
0
1
2
3
4
5
6
7
2
3
A
A
E
E
E
1
2
3
4
5
6
7
MLB312  
Fig.1 Pin configuration.  
Fig.2 Logic symbol.  
(a)  
(b)  
Fig.3 IEC logic symbol.  
Fig.4 Functional diagram.  
September 1993  
3
Philips Semiconductors  
Product specification  
3-to-8 line decoder/demultiplexer; inverting  
74HC/HCT138  
FUNCTION TABLE  
INPUTS  
OUTPUTS  
E1  
E2  
E3  
A0  
A1  
A2  
Y0  
Y1  
Y2  
Y3  
Y4  
Y5  
Y6  
Y7  
H
X
X
X
H
X
X
X
L
X
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X
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X
X
X
X
X
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L
L
L
L
H
H
H
H
L
H
L
L
L
H
H
H
H
H
H
H
H
H
H
H
H
H
H
H
H
H
H
H
H
H
H
L
H
H
H
H
L
H
H
H
H
L
H
H
H
L
H
H
Notes  
1. H = HIGH voltage level  
L = LOW voltage level  
X = don’t care  
Fig.5 Logic diagram.  
September 1993  
4
Philips Semiconductors  
Product specification  
3-to-8 line decoder/demultiplexer; inverting  
74HC/HCT138  
DC CHARACTERISTICS FOR 74HC  
For the DC characteristics see “74HC/HCT/HCU/HCMOS Logic Family Specifications”.  
Output capability: standard  
ICC category: MSI  
AC CHARACTERISTICS FOR 74HC  
GND = 0 V; tr = tf = 6 ns; CL = 50 pF  
Tamb (°C)  
TEST CONDITIONS  
74HC  
SYMBOL PARAMETER  
UNIT  
WAVEFORMS  
VCC  
(V)  
+25  
40 to +85  
40 to +125  
min. typ. max. min. max. min. max.  
41  
15  
12  
150  
30  
26  
190  
38  
33  
225  
45  
38  
2.0  
4.5  
6.0  
propagation delay  
An to Yn  
tPHL/ tPLH  
ns  
Fig.6  
47  
17  
14  
150  
30  
26  
190  
38  
33  
225  
45  
38  
2.0  
4.5  
6.0  
propagation delay  
E3 to Yn  
t
t
t
PHL/ tPLH  
PHL/ tPLH  
THL/ tTLH  
ns  
ns  
ns  
Fig.6  
47  
17  
14  
150  
30  
26  
190  
38  
33  
225  
45  
38  
2.0  
4.5  
6.0  
propagation delay  
En to Yn  
Fig.7  
19  
7
6
75  
15  
13  
95  
19  
16  
110  
22  
19  
2.0  
4.5  
6.0  
output transition  
time  
Figs 6 and 7  
September 1993  
5
Philips Semiconductors  
Product specification  
3-to-8 line decoder/demultiplexer; inverting  
74HC/HCT138  
DC CHARACTERISTICS FOR 74HCT  
For the DC characteristics see “74HC/HCT/HCU/HCMOS Logic Family Specifications”.  
Output capability: standard  
ICC category: MSI  
Note to HCT types  
The value of additional quiescent supply current (ICC) for a unit load of 1 is given in the family specifications. To  
determine ICC per input, multiply this value by the unit load coefficient shown in the table below.  
INPUT  
UNIT LOAD COEFFICIENT  
An  
En  
E3  
1.50  
1.25  
1.00  
AC CHARACTERISTICS FOR 74HCT  
GND = 0 V; tr = tf = 6 ns; CL = 50 pF  
Tamb (°C)  
TEST CONDITIONS  
74HCT  
SYMBOL PARAMETER  
UNIT  
WAVEFORMS  
VCC  
(V)  
+25  
40 to +85  
40 to +125  
min. typ. max. min. max. min. max.  
propagation delay  
An to Yn  
tPHL/ tPLH  
20  
18  
19  
7
35  
40  
40  
15  
44  
50  
50  
19  
53  
60  
60  
22  
ns  
4.5  
4.5  
4.5  
4.5  
Fig.6  
propagation delay  
E3 to Yn  
t
t
PHL/ tPLH  
PHL/ tPLH  
ns  
ns  
ns  
Fig.6  
propagation delay  
En to Yn  
Fig.7  
output transition  
time  
tTHL/ tTLH  
Figs 6 and 7  
September 1993  
6
Philips Semiconductors  
Product specification  
3-to-8 line decoder/demultiplexer; inverting  
74HC/HCT138  
AC WAVEFORMS  
(1) HC : VM = 50%; VI = GND to VCC  
.
HCT: VM = 1.3 V; VI = GND to 3 V.  
Fig.6 Waveforms showing the address input (An) and enable input (E3) to output (Yn) propagation delays and  
the output transition times.  
(1) HC : VM = 50%; VI = GND to VCC  
.
HCT: VM = 1.3 V; VI = GND to 3 V.  
Fig.7 Waveforms showing the enable input (En) to output (Yn) propagation delays and the output transition  
times.  
PACKAGE OUTLINES  
See “74HC/HCT/HCU/HCMOS Logic Package Outlines”.  
September 1993  
7
配单直通车
74HC138BQ产品参数
型号:74HC138BQ
是否无铅: 不含铅
是否Rohs认证: 符合
生命周期:Transferred
零件包装代码:QFN
包装说明:HVQCCN, LCC16,.1X.14,20
针数:16
Reach Compliance Code:compliant
ECCN代码:EAR99
HTS代码:8542.39.00.01
风险等级:5.28
系列:HC/UH
输入调节:STANDARD
JESD-30 代码:R-PQCC-N16
JESD-609代码:e4
长度:3.5 mm
负载电容(CL):50 pF
逻辑集成电路类型:OTHER DECODER/DRIVER
最大I(ol):0.004 A
湿度敏感等级:1
功能数量:1
端子数量:16
最高工作温度:125 °C
最低工作温度:-40 °C
输出极性:INVERTED
封装主体材料:PLASTIC/EPOXY
封装代码:HVQCCN
封装等效代码:LCC16,.1X.14,20
封装形状:RECTANGULAR
封装形式:CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
峰值回流温度(摄氏度):260
电源:2/6 V
Prop。Delay @ Nom-Sup:45 ns
传播延迟(tpd):225 ns
认证状态:Not Qualified
座面最大高度:1 mm
子类别:Decoder/Drivers
最大供电电压 (Vsup):6 V
最小供电电压 (Vsup):2 V
标称供电电压 (Vsup):5 V
表面贴装:YES
技术:CMOS
温度等级:AUTOMOTIVE
端子面层:Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式:NO LEAD
端子节距:0.5 mm
端子位置:QUAD
处于峰值回流温度下的最长时间:30
宽度:2.5 mm
Base Number Matches:1
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