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CMS4A16LAG 参数 Datasheet PDF下载

CMS4A16LAG图片预览
型号: CMS4A16LAG
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内容描述: 128M ( 8Mx16 )低功耗SDRAM [128M(8Mx16) Low Power SDRAM]
分类和应用: 动态存储器
文件页数/大小: 46 页 / 616 K
品牌: FIDELIX [ FIDELIX ]
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CMS4A16LAx–75xx
表2.突发长度的定义。
访问顺序的内爆
突发长度
起始列地址
类型=顺序
A0
2
0
1
A1 A0
00
4
01
10
11
A2 A1 A0
000
001
010
8
011
100
101
110
111
全页( Y)
N = A0 -A8 (位置0 -Y )
0-1-2-3-4-5-6-7
1-2-3-4-5-6-7-0
2-3-4-5-6-7-0-1
3-4-5-6-7-0-1-2
4-5-6-7-0-1-2-3
5-6-7-0-1-2-3-4
6-7-0-1-2-3-4-5
7-0-1-2-3-4-5-6
BN ,BN + 1 ,BN + 2 ... ..Bn , ...
0-1-2-3-4-5-6-7
1-0-3-2-5-4-7-6
2-3-0-1-6-7-4-5
3-2-1-0-7-6-5-4
4-5-6-7-0-1-2-3
5-4-7-6-1-0-3-2
6-7-4-5-2-3-0-1
7-6-5-4-3-2-1-0
不支持
0-1-2-3
1-2-3-0
2-3-0-1
3-0-1-2
0-1-2-3
1-0-3-2
2-3-0-1
3-2-1-0
0-1
1-0
0-1
1-0
类型=交错
经营模式
在正常的操作模式是通过将M7和M8
到零;值的M7和M8的其它组合
保留以供将来使用和/或测试modes.Test模式
内敛的状态不应该被使用,因为未知
操作或不符合将来的版本可能会导致。
CAS延迟
CAS延迟是延迟,时钟周期之间的
一个READ命令的登记和的可用性
第一个输出数据段。该延迟可以被设置为一个,两个,
三个时钟。如果读命令注册在时钟边沿
r,
和等待时间是
q
时钟,该数据将提供由时钟
EDGE
R + Q 。
所述的DQ将开始驱动作为时钟的结果
缘在一个周期之前
(R + q-基1) ,
并提供了相关的
访问时间得到满足,该数据将是时钟边沿有效
R + Q 。
例如, assumi吴日在前作时钟周期的时间
使得所有相关的存取时间都满足时,如果一个READ
命令被记录在T0和所述延迟被编程
两个时钟, DQS的开始后, T1和数据驱动
将是有效的通过T 2 ,如图2中所示。
表3表示出了工作频率在每个CAS号
延迟设置都可以使用。保留的国家不应该
作为未知的操作或不符合未来
版本可能会导致。
写突发模式
当M9 = 0时,脉冲串长度通过M0〜 M2的编程适用于
读取和写入阵阵;当M9 = 1,则程序
突发长度适用于读阵阵,但写访问
单位置(非连拍)访问。
修订版0.4 11月06
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