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ASM2I9940LG-32-ET 参数 Datasheet PDF下载

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型号: ASM2I9940LG-32-ET
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内容描述: 低电压1:18时钟分配芯片 [Low Voltage 1:18 Clock Distribution Chip]
分类和应用: 时钟驱动器逻辑集成电路
文件页数/大小: 13 页 / 485 K
品牌: PULSECORE [ PulseCore Semiconductor ]
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2007年4月
修订版1.2
表5. DC特性
(T
A
= -40 °至+ 85°C ,V
CCI
= 3.3V ± 5%, V
CCO
= 3.3V ± 5%)
符号
V
IH
V
IL
V
PP
V
CMR
V
OH
V
OL
I
IN
C
IN
C
pd
Z
OUT
I
CC
ASM2I9940L
特征
输入高电压
输入低电压
峰 - 峰值输入
电压
共模范围
输出高电压
输出低电压
输入电流
输入电容
功率耗散电容
输出阻抗
最大静态电源电流
CMOS_CLK
CMOS_CLK
PECL_CLK
PECL_CLK
2.0
典型值
最大
V
CCI
0.8
单位
V
V
mV
V
V
条件
500
V
CC-
1.4
2.4
1000
V
CC-
0.6
I
OH
= -20mA
I
OH
= 20mA下
0.5
±200
4.0
10
18
23
0.5
28
1.0
V
µA
pF
pF
mA
每路输出
表6. AC特性
(T
A
= -40 °至+ 85°C ,V
CCI
= 3.3V ± 5%, V
CCO
= 3.3V ± 5%)
符号
F
最大
t
PLH
t
PLH
t
SK ( O)
t
SK (PP)的
t
SK (PP)的
t
SK (PP)的
DC
t
r
, t
f
特征
最大输入频率
传播延迟
传播延迟
输出至输出扭曲
部分到部分斜
部分到部分斜
部分到部分斜
输出占空比
输出上升/下降时间
PECL_CLK < 150MHz的
CMOS_CLK < 150MHz的
PECL_CLK > 150MHz的
CMOS_CLK > 150MHz的
PECL_CLK
CMOS_CLK
PECL_CLK < 150MHz的
CMOS_CLK < 150MHz的
PECL_CLK > 150MHz的
CMOS_CLK > 150MHz的
PECL_CLK CMOS_CLK
f
CLK
< 134兆赫
f
CLK
<250兆赫
典型值
最大
250
单位
兆赫
nS
nS
pS
nS
nS
pS
%
%
nS
条件
2.0
1.7
2.0
1.8
2.7
2.5
2.9
2.5
3.4
3.0
3.7
3.2
150
150
1.5
1.3
1.8
1.5
850
750
1
.
1
注。
笔记
1,2
笔记
笔记
1,2
1,3
45
40
0.3
50
50
55
60
1.1
输入DC = 50%的
输入DC = 50%的
0.5 – 2.4 V
注:1,使用标准的输入电平测试,生产测试@ 150MHz的。
2.在整个温度和电压范围,包括输出偏斜。
3.对于特定的温度和电压,包括输出偏斜。
低电压1:18时钟分配芯片
注意:本文档中的信息如有更改,恕不另行通知。
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