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    CY28372OCT 参数 Datasheet PDF下载

    CY28372OCT图片预览
    型号： CY28372OCT
    PDF下载： 下载PDF文件 查看货源
    内容描述： 矽统746的AMD Athlon ™ / AMD的Duron ™时钟合成器 [SiS 746 AMD Athlon⑩/AMD Duron⑩ Clock Synthesizer]
    分类和应用： 晶体外围集成电路光电二极管时钟
    文件页数/大小： 17 页 / 227 K
    品牌： SPECTRALINEAR [ SPECTRALINEAR INC ]
     浏览型号CY28372OCT的Datasheet PDF文件第1页浏览型号CY28372OCT的Datasheet PDF文件第2页浏览型号CY28372OCT的Datasheet PDF文件第4页浏览型号CY28372OCT的Datasheet PDF文件第5页浏览型号CY28372OCT的Datasheet PDF文件第6页浏览型号CY28372OCT的Datasheet PDF文件第7页浏览型号CY28372OCT的Datasheet PDF文件第8页浏览型号CY28372OCT的Datasheet PDF文件第9页  
    CY28372
    表1.频率选择表
    输入条件
    选项
    （ 4个字节，第2位）
    0
    0
    0
    0
    0
    0
    0
    0
    0
    0
    0
    0
    0
    0
    0
    0
    1
    1
    1
    1
    1
    1
    1
    1
    1
    1
    1
    1
    1
    1
    1
    1
    （默认）
    I
    2
    C
    FS（ 3：0 ）
    0000
    0001
    0010
    0011
    0100
    0101
    0110
    0111
    1000
    1001
    1010
    1011
    1100
    1101
    1110
    1111
    0000
    0001
    0010
    0011
    0100
    0101
    0110
    0111
    1000
    1001
    1010
    1011
    1100
    1101
    1110
    1111
    中央处理器
    （兆赫）
    133.3
    133.3
    133.3
    133.3
    133.3
    133.3
    133.3
    133.3
    100.0
    100.0
    100.0
    100.0
    100.0
    100.0
    111.0
    111.0
    114.5
    120.0
    133.3
    133.3
    133.3
    145.7
    150.0
    166.6
    111.1
    137.4
    144.9
    150.0
    155.1
    166.6
    180.1
    200.0
    输出频率
    ZCLK
    （兆赫）
    66.7
    66.7
    100.0
    100.0
    133.3
    133.3
    166.6
    166.6
    66.7
    66.7
    100.0
    100.0
    133.3
    133.3
    166.5
    166.5
    95.4
    100.0
    83.3
    111.1
    133.3
    116.6
    100.0
    111.1
    133.3
    137.4
    144.9
    150.0
    124.1
    133.3
    135.1
    133.3
    AGP
    （兆赫）
    66.7
    50.0
    66.7
    50.0
    66.7
    50.0
    66.7
    55.5
    66.7
    50.0
    66.7
    50.0
    66.7
    50.0
    66.6
    55.5
    63.6
    66.7
    66.7
    74.1
    83.3
    64.8
    66.7
    66.7
    66.7
    68.7
    64.4
    66.7
    68.9
    66.7
    67.6
    66.7
    PCI
    （兆赫）
    33.3
    33.3
    33.3
    33.3
    33.3
    33.3
    33.3
    33.3
    33.3
    33.3
    33.3
    33.3
    33.3
    33.3
    33.3
    33.3
    31.8
    33.3
    33.3
    33.3
    33.3
    32.4
    33.3
    33.3
    33.3
    34.4
    32.2
    33.3
    34.5
    33.3
    33.8
    33.3
    VCO
    频率。
    （兆赫）
    400.0
    400.0
    400.0
    400.0
    400.0
    400.0
    666.5
    666.5
    400.0
    400.0
    400.0
    400.0
    400.0
    400.0
    666.1
    666.1
    572.5
    600.0
    666.5
    666.5
    666.5
    582.8
    600.0
    666.5
    666.5
    549.6
    579.5
    600.0
    620.3
    666.5
    540.4
    400.0
    串行数据接口
    以提高的时钟合成器的灵活性和功能，
    提供了一种双信号的串行接口。通过串口
    数据接口，各种设备的功能，如个人
    时钟输出缓冲器，可以单独启用或禁用。
    与串行数据接口相关的寄存器
    初始化为它们的默认设置上电时，并且因此
    使用此接口是可选的。时钟器件的寄存器变化
    在系统初始化时，通常制成，如果有的话是
    所需。该接口也可制过程中使用的
    操作的功率管理功能。
    数据协议
    时钟驱动器的串行协议接收字节写，读字节，
    块写入和块从控制器读取操作。为
    块写入/读取操作，字节必须访问
    按顺序从最低到最高字节（最显著
    位在前）有能力停止后的任何完整的字节有
    被转移。对于字节写和字节读取操作时，
    系统控制器可以访问单独的索引字节。该
    被索引的字节的偏移被编码在命令代码，
    如上述
    表2中。
    1.0版， 2006年11月20日
    第17页3

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