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  • 集好芯城

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  • 深圳市宏世佳电子科技有限公司

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  • 深圳市宏捷佳电子科技有限公司

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  • 厂家CYPRESS/赛普拉斯 
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  • 北京元坤伟业科技有限公司

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  • HECC GROUP CO.,LIMITED

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  • 深圳市毅创腾电子科技有限公司

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  • 深圳市华斯顿电子科技有限公司

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  • 深圳分公司0755-83777708“进口原装正品专供” QQ:1002316308QQ:515102657
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  • 深圳市硅诺电子科技有限公司

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  • 上海熠富电子科技有限公司

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  • 批号1年内 
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  • 厂家CYPRESS 
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  • 深圳市晶美隆科技有限公司

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  • 深圳市羿芯诚电子有限公司

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  • CY2304SC-1
  • 数量8500 
  • 厂家原厂品牌 
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  • 上海意淼电子科技有限公司

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  • CY2304SC-1
  • 数量20000 
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  • 深圳市芯柏然科技有限公司

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  • 数量2698 
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  • 上海振基实业有限公司

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  • 万三科技(深圳)有限公司

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  • 厂家Cypress Semiconductor Corp 
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  • 深圳市卓越微芯电子有限公司

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  • 深圳市诚达吉电子有限公司

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  • 厂家CYPRESS 
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  • 原装正品 一手现货 假一赔百
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  • 万三科技(深圳)有限公司

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  • 厂家Cypress Semiconductor Corp 
  • 封装原厂原装 
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  • 万三科技 秉承原装 实单可议
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  • 北京睿科新创电子中心

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  • 深圳市华斯顿电子科技有限公司

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  • 厂家CY 
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产品型号CY2304SC-1的概述

CY2304SC-1的概述 CY2304SC-1是一种高性能时钟发生器,广泛应用于通信、消费电子、计算机及工业控制等多个领域。该芯片由Cypress Semiconductor(现为Infineon Technologies的一部分)设计,该公司以其在数字信号处理和时钟管理方面的技术而闻名。CY2304SC-1集成了分频器、相位锁定环(PLL)及输出驱动器等多个功能,使其能够在各种条件下生成稳定的时钟信号。 CY2304SC-1的工作原理是通过接收输入时钟信号,经过内部电路的处理,输出频率可调的时钟信号。该芯片支持多种输出频率设置,方便用户根据不同应用需求进行调整。这种灵活性使其在市场上赢得了广泛关注,并在日益复杂的电子系统中发挥重要作用。 CY2304SC-1的详细参数 CY2304SC-1的主要技术参数如下: 1. 工作电压:1.8V至3.3V 2. 工作温度范围:-40°C 至 ...

产品型号CY2304SC-1的Datasheet PDF文件预览

CY2304  
3.3V Zero Delay Buffer  
The part has an on-chip phase-locked loop (PLL) that locks to  
an input clock presented on the REF pin. The PLL feedback is  
required to be driven into the FBK pin, and can be obtained  
from one of the outputs. The input-to-output skew is  
guaranteed to be less than 250 ps, and output-to-output skew  
is guaranteed to be less than 200 ps.  
Features  
• Zero input-output propagation delay, adjustable by  
capacitive load on FBK input  
• Multiple configurations – see “Available Configura-  
tions” table  
The CY2304 has two banks of two outputs each.  
• Multiple low-skew outputs  
The CY2304 PLL enters a power-down state when there are  
no rising edges on the REF input. In this mode, all outputs are  
three-stated and the PLL is turned off, resulting in less than  
25 µA of current draw.  
— Output-output skew less than 200 ps  
— Device-device skew less than 500 ps  
• 10-MHz to 133-MHz operating range  
• Low jitter, less than 200 ps cycle-cycle  
• Space-saving 8-pin 150-mil SOIC package  
• 3.3V operation  
Multiple CY2304 devices can accept the same input clock and  
distribute it in a system. In this case, the skew between the  
outputs of two devices is guaranteed to be less than 500 ps.  
The CY2304 is available in two different configurations, as  
shown in the Available Configurationstable. The CY23041  
is the base part, where the output frequencies equal the  
reference if there is no counter in the feedback path.  
• Industrial temperature available  
Functional Description  
The CY2304 is a 3.3V zero delay buffer designed to distribute  
high-speed clocks in PC, workstation, datacom, telecom, and  
other high-performance applications.  
The CY23042 allows the user to obtain Ref and 1/2x or 2x  
frequencies on each output bank. The exact configuration and  
output frequencies depends on which output drives the  
feedback pin.  
Pin Configuration  
Logic Block Diagram  
FBK  
8-pin SOIC  
Top View  
CLKA1  
1
2
3
4
8
7
6
FBK  
V
DD  
REF  
PLL  
REF  
CLKA1  
CLKA2  
GND  
CLKB2  
CLKB1  
CLKA2  
5
/2  
Extra Divider (-2)  
CLKB1  
CLKB2  
Available Configurations  
Device  
FBK from  
Bank A Frequency Bank B Frequency  
CY2304-1  
CY2304-2  
CY2304-2  
Bank A or B  
Bank A  
Reference  
Reference  
Reference  
Reference/2  
Reference  
Bank B  
2 × Reference  
Cypress Semiconductor Corporation  
3901 North First Street  
San Jose  
CA 95134  
408-943-2600  
Document #: 38-07247 Rev. *C  
Revised December 7, 2002  
CY2304  
Pin Description  
Pin  
Signal  
Description  
Input reference frequency, 5V-tolerant input  
1
2
3
4
5
6
7
8
REF[1]  
CLKA1[2]  
CLKA2[2]  
GND  
CLKB1[2]  
CLKB2[2]  
VDD  
Clock output, Bank A  
Clock output, Bank A  
Ground  
Clock output, Bank B  
Clock output, Bank B  
3.3V supply  
FBK  
PLL feedback input  
Zero Delay and Skew Control  
REF. Input to CLKA/CLKB Delay vs. Difference in Loading Between FBK Pin and CLKA/CLKB Pins  
To close the feedback loop of the CY2304, the FBK pin can be  
driven from any of the four available output pins. The output  
driving the FBK pin will be driving a total load of 7 pF plus any  
additional load that it drives. The relative loading of this output  
(with respect to the remaining outputs) can adjust the  
input-output delay. This is shown in the graph above.  
loaded. If input-output delay adjustments are required, use the  
above graph to calculate loading differences between the  
feedback output and remaining outputs.  
For zero output-output skew, be sure to load outputs equally.  
For further information on using CY2304, refer to the appli-  
cation note CY2308: Zero Delay Buffer.”  
For applications requiring zero input-output delay, all outputs  
including the one providing feedback should be equally  
Notes:  
1. Weak pull-down.  
2. Weak pull-down on all outputs.  
Document #: 38-07247 Rev. *C  
Page 2 of 8  
CY2304  
Maximum Ratings  
Supply Voltage to Ground Potential.................0.5V to +7.0V  
DC Input Voltage (Except Ref)...............0.5V to VDD + 0.5V  
DC Input Voltage REF.............................................0.5 to 7V  
Storage Temperature ..................................65°C to +150°C  
Junction Temperature ..................................................150°C  
Static Discharge Voltage  
(per MIL-STD-883, Method 3015).............................> 2000V  
Operating Conditions for CY2304SC-X Commercial Temperature Devices  
Parameter  
Description  
Min.  
3.0  
0
Max.  
3.6  
70  
Unit  
V
VDD  
Supply Voltage  
TA  
CL  
Operating Temperature (Ambient Temperature)  
Load Capacitance (below 100 MHz)  
Load Capacitance (from 100 MHz to 133 MHz)  
Input Capacitance[3]  
°C  
pF  
pF  
pF  
30  
15  
CIN  
tPU  
7
Power-up time for all VDD's to reach minimum specified voltage  
(power ramps must be monotonic)  
0.05  
50  
ms  
Electrical Characteristics for CY2304SC-X Commercial Temperature Devices  
Parameter  
Description  
Input LOW Voltage  
Input HIGH Voltage  
Input LOW Current  
Input HIGH Current  
Output LOW Voltage[4]  
Output HIGH Voltage[4]  
Test Conditions  
Min.  
Max.  
Unit  
V
VIL  
VIH  
IIL  
0.8  
2.0  
V
VIN = 0V  
50.0  
100.0  
0.4  
µA  
µA  
V
IIH  
VIN = VDD  
VOL  
IOL = 8 mA (1, 2)  
IOH = 8 mA (1, 2)  
VOH  
2.4  
V
IDD (PD mode)  
IDD  
Power-down Supply Current REF = 0 MHz  
12.0  
45.0  
µA  
mA  
Supply Current Unloaded outputs, 100-MHz REF,  
Select inputs at VDD or GND  
Unloaded outputs, 66-MHz REF  
(1,2)  
32.0  
18.0  
mA  
mA  
Unloaded outputs, 33-MHz REF  
(1,2)  
Switching Characteristics for CY2304SC-X Commercial Temperature Devices [5]  
Parameter  
t1  
t1  
Name  
Test Conditions  
30-pF load, all devices  
Min.  
10  
Typ.  
Max. Unit  
Output Frequency  
Output Frequency  
100  
MHz  
15-pF load, 1, 2 devices  
10  
133.3 MHz  
Duty Cycle[4] = t2 ÷ t1  
(1,2)  
Duty Cycle[4] = t2 ÷ t1  
(1,2)  
Rise Time[4]  
(1, 2)  
Measured at 1.4V, FOUT = 66.66 MHz 30-pF load  
40.0  
50.0  
50.0  
60.0  
55.0  
2.20  
1.50  
%
%
Measured at 1.4V, FOUT < 50.0 MHz 15-pF load  
Measured between 0.8V and 2.0V, 30-pF load  
Measured between 0.8V and 2.0V, 15-pF load  
45.0  
t3  
ns  
ns  
t3  
Rise Time[4]  
(1, 2)  
Notes:  
3. Applies to both REF clock and FBK.  
4. Parameter is guaranteed by design and characterization. Not 100% tested in production.  
5. All parameters are specified with loaded output.  
Document #: 38-07247 Rev. *C  
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CY2304  
Switching Characteristics for CY2304SC-X Commercial Temperature Devices (continued)[5]  
Parameter  
t4  
Name  
Fall Time[4]  
(1, 2)  
Fall Time[4]  
(1, 2)  
Test Conditions  
Min.  
Typ.  
Max. Unit  
Measured between 0.8V and 2.0V,  
30-pF load  
2.20  
1.50  
200  
ns  
ns  
ps  
ps  
ps  
ps  
ps  
t4  
t5  
Measured between 0.8V and 2.0V,  
15-pF load  
Output-to-Output Skew All outputs equally loaded  
on same Bank (1,2)[4]  
OutputBankAtoOutput All outputs equally loaded  
Bank B Skew (1)  
200  
OutputBankAtoOutput All outputs equally loaded  
Bank B Skew (2)  
400  
t6  
t7  
tJ  
Skew, REF Rising Edge Measured at VDD/2  
to FBK Rising Edge[4]  
0
0
±250  
500  
Device-to-Device  
Skew[4]  
Measured at VDD/2 on the FBK pins of devices  
Cycle-to-Cycle Jitter[4] Measured at 66.67 MHz, loaded outputs, 15-pF load  
(1)  
175  
200  
100  
400  
375  
1.0  
ps  
ps  
ps  
ps  
ps  
ms  
Measured at 66.67 MHz, loaded outputs, 30-pF load  
Measured at 133.3 MHz, loaded outputs, 15 pF load  
tJ  
Cycle-to-Cycle Jitter[4] Measured at 66.67 MHz, loaded outputs 30-pF load  
(2)  
Measured at 66.67 MHz, loaded outputs 15-pF load  
tLOCK  
PLL Lock Time[4]  
Stable power supply, valid clocks presented on REF  
and FBK pins  
Operating Conditions for CY2304SI-X Industrial Temperature Devices  
Parameter  
Description  
Min.  
3.0  
Max.  
3.6  
85  
Unit  
VDD  
TA  
Supply Voltage  
V
Operating Temperature (Ambient Temperature)  
Load Capacitance (below 100 MHz)  
Load Capacitance (from 100 MHz to 133 MHz)  
Input Capacitance  
-40  
°C  
pF  
pF  
pF  
CL  
30  
15  
CIN  
7
[5]  
Switching Characteristics for CY2304SI-X Industrial Temperature Devices  
Parameter  
t1  
Name  
Output Frequency  
Output Frequency  
Duty Cycle[4] = t2 ÷ t1  
(1,2)  
Duty Cycle[4] = t2 ÷ t1  
(1,2)  
Rise Time[4]  
(1, 2)  
Rise Time[4]  
(1, 2)  
Fall Time[4]  
Test Conditions  
30-pF load, All devices  
Min.  
10  
Typ.  
Max.  
Unit  
100  
133.3  
60.0  
MHz  
MHz  
%
t1  
15-pF load, All devices  
10  
Measured at 1.4V, FOUT = 66.66 MHz  
30-pF load  
40.0  
50.0  
50.0  
Measured at 1.4V, FOUT < 50.0 MHz  
15-pF load  
45.0  
55.0  
2.50  
1.50  
2.50  
1.50  
%
ns  
ns  
ns  
ns  
t3  
t3  
t4  
t4  
Measured between 0.8V and 2.0V,  
30-pF load  
Measured between 0.8V and 2.0V,  
15-pF load  
Measured between 0.8V and 2.0V,  
30-pF load  
(1, 2)  
Fall Time[4]  
(1, 2)  
Measured between 0.8V and 2.0V,  
15-pF load  
Document #: 38-07247 Rev. *C  
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CY2304  
Switching Characteristics for CY2304SI-X Industrial Temperature Devices (continued)[5]  
Parameter  
t5  
Name  
Test Conditions  
Min.  
Typ.  
Max.  
Unit  
Output-to-Output Skew on  
All outputs equally loaded  
200  
200  
400  
±250  
500  
180  
200  
100  
400  
380  
1.0  
ps  
same Bank (1,2)[4]  
Output BankA to Output Bank All outputs equally loaded  
B Skew (1)  
ps  
ps  
ps  
ps  
ps  
ps  
ps  
ps  
ps  
ms  
Output BankA to Output Bank All outputs equally loaded  
B Skew (2)  
t6  
t7  
tJ  
Skew, REF Rising Edge to  
FBK Rising Edge[4]  
Device-to-Device Skew[4]  
Measured at VDD/2  
0
0
Measured at VDD/2 on the FBK pins of  
devices  
Cycle-to-Cycle Jitter[4]  
Measured at 66.67 MHz, loaded outputs,  
15-pF load  
(1)  
Measured at 66.67 MHz, loaded outputs,  
30-pF load  
Measured at 133.3 MHz, loaded outputs,  
15 pF load  
tJ  
Cycle-to-Cycle Jitter[4]  
Measured at 66.67 MHz, loaded outputs,  
30-pF load  
(2)  
Measured at 66.67 MHz, loaded outputs,  
15-pF load  
tLOCK  
PLL Lock Time[4]  
Stable power supply, valid clocks  
presented on REF and FBK pins  
Electrical Characteristics for CY2304SI-X Industrial Temperature Devices  
Parameter  
Description  
Input LOW Voltage  
Input HIGH Voltage  
Input LOW Current  
Input HIGH Current  
Output LOW Voltage[4]  
Output HIGH Voltage[4]  
Test Conditions  
Min.  
Max.  
Unit  
VIL  
VIH  
IIL  
0.8  
V
V
2.0  
VIN = 0V  
50.0  
100.0  
0.4  
µA  
µA  
V
IIH  
VIN = VDD  
VOL  
IOL = 8 mA (1, 2)  
IOH = 8 mA (1, 2)  
VOH  
2.4  
V
IDD (PD mode)  
IDD  
Power-down Supply Current REF = 0 MHz  
25.0  
45.0  
µA  
mA  
Supply Current Unloaded outputs, 100 MHz,  
Select inputs at VDD or GND  
Unloaded outputs, 66-MHz REF  
(1, 2)  
35.0  
20.0  
mA  
mA  
Unloaded outputs, 33-MHz REF  
(1, 2)  
Switching Waveforms  
Duty Cycle Timing  
t
1
t
2
1.4V  
1.4V  
1.4V  
Document #: 38-07247 Rev. *C  
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CY2304  
Switching Waveforms  
All Outputs Rise/Fall Time  
3.3V  
0V  
2.0V  
OUTPUT  
0.8V  
2.0V  
0.8V  
t
3
t
4
Output-Output Skew  
1.4V  
OUTPUT  
1.4V  
OUTPUT  
t
5
Input-Output Skew  
V
/2  
DD  
INPUT  
V
/2  
DD  
FBK  
t
6
Device-Device Skew  
V
/2  
DD  
FBK, Device 1  
V
/2  
DD  
FBK, Device 2  
t
7
Test Circuits  
Test Circuit # 1  
VDD  
CLK OUT  
CLOAD  
0.1 µF  
0.1 µF  
OUTPUTS  
VDD  
GND  
GND  
Test circuit for all parameters except t8  
Document #: 38-07247 Rev. *C  
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CY2304  
Ordering Information  
Ordering Code  
CY2304SC1  
Package Name  
Package Type  
8-pin 150-mil SOIC  
Operating Range  
Commercial  
S8  
S8  
S8  
S8  
CY2304SI1  
8-pin 150-mil SOIC  
8-pin 150-mil SOIC  
8-pin 150-mil SOIC  
Industrial  
CY2304SC2  
Commercial  
Industrial  
CY2304SI2  
Package Diagram  
8-lead (150-Mil) SOIC S8  
51-85066-A  
Document #: 38-07247 Rev. *C  
Page 7 of 8  
© Cypress Semiconductor Corporation, 2002. The information contained herein is subject to change without notice. Cypress Semiconductor Corporation assumes no responsibility for the use  
of any circuitry other than circuitry embodied in a Cypress Semiconductor product. Nor does it convey or imply any license under patent or other rights. Cypress Semiconductor does not authorize  
its products for use as critical components in life-support systems where a malfunction or failure may reasonably be expected to result in significant injury to the user. The inclusion of Cypress  
Semiconductor products in life-support systems application implies that the manufacturer assumes all risk of such use and in doing so indemnifies Cypress Semiconductor against all charges.  
CY2304  
Document Title: CY2304 3.3V Zero Delay Buffer  
Document Number: 38-07247  
Orig. of  
REV.  
**  
ECN N0. Issue Date Change  
Description of Change  
110512  
112294  
113934  
12/11/01  
03/04/02  
05/01/02  
SZV  
CKN  
CKN  
Change from Spec number: 38-01010 to 38-07247  
*A  
On Pin Configuration Diagram (p.1), swapped CLKA2 and CLKA1  
*B  
Added Operating Conditions for CY2304SI-X Industrial Temperature  
Devices, p. 4  
*C  
121851  
12/14/02  
RBI  
Power up requirements added to Operating Conditions Information  
Document #: 38-07247 Rev. *C  
Page 8 of 8  
配单直通车
CY2304SC-1产品参数
型号:CY2304SC-1
是否无铅: 含铅
是否Rohs认证: 不符合
生命周期:Active
零件包装代码:SOIC
包装说明:SOP,
针数:8
Reach Compliance Code:unknown
风险等级:5.7
系列:2304
输入调节:STANDARD
JESD-30 代码:R-PDSO-G8
JESD-609代码:e0
长度:4.889 mm
逻辑集成电路类型:PLL BASED CLOCK DRIVER
湿度敏感等级:1
功能数量:1
反相输出次数:
端子数量:8
实输出次数:4
最高工作温度:70 °C
最低工作温度:
输出特性:3-STATE
封装主体材料:PLASTIC/EPOXY
封装代码:SOP
封装形状:RECTANGULAR
封装形式:SMALL OUTLINE
峰值回流温度(摄氏度):220
认证状态:COMMERCIAL
Same Edge Skew-Max(tskwd):0.2 ns
座面最大高度:1.727 mm
最大供电电压 (Vsup):3.6 V
最小供电电压 (Vsup):3 V
标称供电电压 (Vsup):3.3 V
表面贴装:YES
技术:CMOS
温度等级:COMMERCIAL
端子面层:TIN LEAD
端子形式:GULL WING
端子节距:1.27 mm
端子位置:DUAL
处于峰值回流温度下的最长时间:NOT SPECIFIED
宽度:3.8985 mm
最小 fmax:133.3 MHz
Base Number Matches:1
  •  
  • 供货商
  • 型号 *
  • 数量*
  • 厂商
  • 封装
  • 批号
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