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9 월 4 일, 중국 반도체 산업 협회 IC 디자인 지사가 주최 한 "5G 칩 포럼"은 "매우 뜨겁다". 전문가들은 인공 지능, 사물 인터넷, 지능형 시스템 설계, RF 프론트 엔드 기술, 네트워크 칩 기술 및 기타 관점에서 "5G 및 집적 회로 산업 기회"주제를 논의하여 5G 시대의 집적 회로 산업의 기회와 과제를 탐구했습니다.

ZTE Microelectronics Cable Product Center의 수석 엔지니어 Wang Zhizhong :

5G 네트워크 칩이 직면 한 문제는 두 가지 수준에서 볼 수 있습니다. 하나는 기본 설계 수준이고 다른 하나는 새로운 요구 사항 수준입니다. 현재 네트워크 속도는 계속 증가하고 있으며 56G ~ 112G의 고속 인터페이스가 설계되거나 상용화 될 예정이며, 이는 대형 칩입니다. 새로운 5G 성능에서는 낮은 전력 소비, 기능 수준 및 효율성 향상 등이 있으므로 많은 과제가 제기됩니다. 새로운 기능은 또한 네트워크 슬라이싱, 낮은 대기 시간, 높은 신뢰성, 고정밀 클록 등을 포함하여 칩 아키텍처에 기술적 인 문제를 제기합니다. 대규모 연결은 밀도 또는 룩업 테이블 용량에 문제를 일으 킵니다.

PZB의 설계는 점점 더 어려울 수 있으므로 게이블 상호 연결 솔루션이 점차적으로 적용될 수 있습니다. PAM8을 사용하는 200G 기술은 5 년 안에 점차 모든 사람의 시야에 들어올 것으로 예상됩니다.

대규모 칩 설계에서는 시스템이 점점 간소화되고 통합이 점점 더 높아지고 있기 때문에 백플레인 스위칭, 라우팅 및 다양한 기능을 포함한 모든 인터페이스, 네트워크 프로세서, CPU가 통합되어 필연적으로 칩의 규모가 점점 커지고 있습니다. 빅 칩의 과제는 무엇입니까? 먼저, 수율, 신호 무결성 및 전력 무결성 과제는 매우 큽니다. 새로운 칩은 종종 3D 메모리 실링, ASIC 세그먼테이션 및 칩 크기와 같은 2.5D 패키징 기술을 사용합니다. 일부 세분화를 수행해야 할 경우 고속 인터페이스 상호 연결이 필요한 이러한 종류의 패키징 기술을 사용해야합니다. 둘째, 칩의 대역폭이 점점 높아지고 있습니다 .1T 또는 2T 모바일 네트워크 스위칭 칩은 업계에서 그리 빠르지는 않지만 캐시의 대역폭 개발은 그리 빠르지 않으므로 유사한 HPM 및 GDDR 기술을 구동 할 것입니다. ZTE 마이크로 일렉트로닉스의 출현은 현재 이러한 많은 설계 방법을 사용합니다. 세 번째는 저전력 설계입니다.

5G의 대규모 연결에서 칩 설계에 MMTC의 대규모 기계 연결이 미치는 영향은 주로 인터페이스 수준에 반영되며, 인터페이스 수가 매우 많기 때문에 많은 논리 단자를 포함하여 다양한 포트가 있습니다. TDM 인터페이스 로직 및 동적 인터페이스 캐싱 기술을 채택합니다. 대규모 연결 문제도 스토리지에 반영되며 검사 목록의 용량이 매우 커서 3D 메모리 기술을 포함한 2.5D 메모리 패키지가 필요합니다.