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型号: | PDL-ACT-8-10 |
生命周期: | Contact Manufacturer |
零件包装代码: | DIP |
包装说明: | QIP, DIP16,.3 |
针数: | 16/12 |
Reach Compliance Code: | unknown |
HTS代码: | 8542.39.00.01 |
风险等级: | 5.73 |
Is Samacsys: | N |
其他特性: | WITH EBAR; MAX FAN OUT OF 10 TTL LOAD PER OUTPUT; INTERNAL TERMINATION; MAX RISE TIME CAPTURED |
系列: | ACT |
JESD-30 代码: | R-XDIP-P12 |
长度: | 22.86 mm |
逻辑集成电路类型: | ACTIVE DELAY LINE |
功能数量: | 1 |
抽头/阶步数: | 7 |
端子数量: | 12 |
最高工作温度: | 85 °C |
最低工作温度: | -40 °C |
输出极性: | COMPLEMENTARY |
封装主体材料: | UNSPECIFIED |
封装代码: | QIP |
封装等效代码: | DIP16,.3 |
封装形状: | RECTANGULAR |
封装形式: | IN-LINE |
电源: | 5 V |
可编程延迟线: | YES |
Prop。Delay @ Nom-Sup: | 78 ns |
认证状态: | Not Qualified |
座面最大高度: | 6.096 mm |
子类别: | Delay Lines |
最大供电电压 (Vsup): | 5.25 V |
最小供电电压 (Vsup): | 4.75 V |
标称供电电压 (Vsup): | 5 V |
表面贴装: | NO |
技术: | CMOS |
温度等级: | INDUSTRIAL |
端子形式: | PIN/PEG |
端子节距: | 2.54 mm |
端子位置: | DUAL |
总延迟标称(td): | 78 ns |
宽度: | 7.62 mm |
Base Number Matches: | 1 |
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