的Stratix GX FPGA系列
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模式检测器和字对齐支持可编程
图案
8B / 10B编码器/解码器执行的8元到10比特编码并-10-
到8比特的解码
速率匹配符合IEEE 802.3-2002的千兆以太网模式
并与IEEE 802-3ae的XAUI模式
通道绑定符合IEEE 802.3ae标准(对于XAUI模式
只)
如果有必要的设备可以绕过一些收发器模块的功能
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FPGA的特点如下:
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10,570至41,250逻辑单元(LE ) ;看
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高达3423744 RAM位( 427968字节)无可用
减少逻辑资源
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的TriMatrix
™
存储器由三个RAM块的大小,以
实现真正的双端口存储器和先入出(FIFO )
缓冲器
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多达16个全局时钟网络与多达22个区域时钟
每个设备区域网络
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高速DSP模块提供专用实施
乘法器(速度超过300 MHz的) ,乘法累加
函数和有限脉冲响应( FIR)滤波器
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多达八个一般使用锁相环( 4增强
每个器件的PLL和四个快速PLL )提供扩频,
可编程带宽,时钟切换,实时PLL
重新配置,以及先进的乘法和相
移
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对于众多的单端和差分I支持/ O
标准
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上了高速源同步差分I / O支持
45通道1 - Gbps的性能
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支持源同步总线标准,包括
万兆以太网XSBI ,并行RapidIO的, UTOPIA IV ,
网络数据包流媒体接口( NPSI )的HyperTransport
TM
技术, SPI-4第2阶段( POS-PHY等级4 ) ,和SFI -4
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支持高速外部存储器,包括零总线
周转( ZBT ) SRAM ,四倍数据率( QDR和QDRII )
SRAM ,双数据速率( DDR ) SDRAM , DDR快速周期RAM
(FCRAM ) ,以及单数据速率(SDR )的SDRAM
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支持从多个知识产权宏功能
Altera公司
®
的MegaCore
®
功能和Altera宏功能合作伙伴
计划(AMPP
SM
)宏功能
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支持远程配置更新
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在LVDS接收器通道动态相位调整
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初步
Altera公司。