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ST16C654IJ68 参数 Datasheet PDF下载

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型号: ST16C654IJ68
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内容描述: 具有64字节FIFO 2.97V至5.5V UART QUAD [2.97V TO 5.5V QUAD UART WITH 64-BYTE FIFO]
分类和应用: 微控制器和处理器串行IO控制器通信控制器外围集成电路先进先出芯片数据传输时钟
文件页数/大小: 51 页 / 911 K
品牌: EXAR [ EXAR CORPORATION ]
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集成4个增强型16C550通用 - 异步接收器的功能和
发送器(UART ) 。每个UART被独立地控制具有其自己的一组设备配置
寄存器。设置配置寄存器的控制,状态和数据传输16550 UART兼容。
此外,每个UART通道都有64字节的发送和接收FIFO ,自动的RTS / CTS硬件
流量控制,自动XON / XOFF和特殊字符软件流控制,红外编码器和解码器
(IRDA版本1.0 ) ,用除法的预分频器1或4,数据传输速率高达1.5可编程的波特率发生器
Mbps的。该ST16C654可以从2.97到5.5伏操作。 654被制造与先进的CMOS
流程。
丰富的功能设置654可通过内部寄存器。自动硬件/软件流
控制,可选的发送和接收FIFO触发电平,可选择的波特率,红外编码器/解码器
接口,调制解调器接口控制和睡眠模式都是标准功能。 MCR位- 5提供了一个工具
为关闭(XON )软件流控制与任何接收( RX )字符。在16模式INTSEL和MCR
比特3可以被配置成提供软件控制的或持续的中断能力。由于引脚限制
对于64针654这个功能是由两个不同的TQFP封装。该ST16C654DCV工作在
连续中断通过内部粘接INTSEL至VCC使能模式。该ST16C654CV操作
与MCR位- 3一起由内部结合INTSEL到GND 。
该ST16C654提供了一个时钟分频器选择引脚允许系统/电路板设计人员预设的默认波特率
上电时费率表。该CLKSEL引脚选择DIV ×1或股利 - 4分频器的波特率发生器。
它然后可以通过MCR位7所覆盖下面的初始化。
100引脚封装提供了一些其他的增强功能。这些功能包括一个CHCCLK时钟输入,
FSTAT寄存器和独立的IrDA TX输出。该CHCCLK必须连接到XTAL2引脚为正常
操作或向外部MIDI (音乐乐器数字接口)振荡器,用于MIDI应用程序。单独
寄存器( FSTAT )提供用于监测FIFO的实时状态信号TXRDY #和RXRDY #
每四个UART通道( A- D) 。这减少了涉及访问单个通道轮询时间。
100引脚QFP封装还提供了四个独立的IrDA (红外线数据标准协会) TX输出
红外应用。这些输出提供在除了标准的异步调制解调器数据
输出。
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增强的FIFO
在654夸脱提供了一个支持64字节的发送和接收FIFO存储器中的溶液,而不是16
在ST16C554字节,或在ST16C454一个字节。在654设计为与高性能的数据到工作
通信系统,需要快速处理数据的时间。提高的性能,实现了654
由较大的发送和接收FIFO , FIFO触发电平控制和自动流控制机制。这
允许外部处理器在给定的时间内处理更多的网络任务。例如,该
ST16C554有一个16字节的FIFO ,卸载16个字节接收1.53 ms的数据(本例中使用的字符
长度为11位,包括启动/停止位为115.2Kbps的) 。这意味着外部CPU将要服务的
接收FIFO 1.53毫秒的间隔。然而,随着在654的64字节FIFO中,数据缓冲器将不要求
卸载/加载为6.1毫秒。这增加了维修的时间间隔给予外部CPU的额外时间
其他应用程序,减少服务中断时间的整体UART 。此外,所述可编程的FIFO
电平触发中断和硬件/软件自动流控制是唯一提供最大的数据
吞吐量性能,尤其在多通道系统中操作时。以上的组合
大大降低了CPU的带宽要求,提高了性能,并降低了功耗。
数据速率
654能够运行在高达1.5 Mbps的在5V与16倍的内部采样时钟速率。该设备可以
在5V高达24 MHz的晶振引脚XTAL1和XTAL2 ,或外部时钟晶体振荡器运行
来源24 MHz的XTAL1引脚上。用,用户的14.7456 MHz和通过软件选择一个典型的晶体
可以设置预分频器位可达921.6 kbps的数据速率。
增强功能




ST16C654/654D
具有64字节FIFO 2.97V至5.5V UART QUAD
REV 。 5.0.0
1.0产品说明
8