256MB和512MB （256 / 256MB ） ， P30-65nm
配置寄存器
表19 ：WAIT功能表（续）
条件
所有的写操作
注意事项：
等待
高-Z
等候断言，直到数据变为有效1.积极的手段，然后拉高。
2.当OE ＃ = V
IH
在写操作，等待=高阻。
笔记
等待延迟
等待时延（ WD ）位控制在同步的等待断言延迟行为
理性的突发读取。 WAIT可以期间或1个数据周期前的有效数据被断言
是DQ输出[ 15 ： 0 ] 。当WD设置，等待撤除一个数据周期
前
有效
数据（默认值） 。当WD清零，等待撤除
中
有效的数据。
突发序列
突发序列（ BS）位选择线性突发序列（默认值） 。只有直线爆SE-
quence支持。对所有脉冲串长度的同步短脉冲串序列，以及
突发包裹（BW）设置的效果如下所示。
表20 ：突发序列的字顺序
突发寻址过程（DEC）
开始
地址
（ DEC）
0
1
2
3
4
5
6
7
⋮
14
15
⋮
0
1
2
3
BURST
WRAP
(RCR3)
0
0
0
0
0
0
0
0
⋮
0
0
⋮
1
1
1
1
⋮
0-1-2-3
1-2-3-4
2-3-4-5
3-4-5-6
⋮
0-1-2-3-4-5-6-7
1-2-3-4-5-6-7-8
2-3-4-5-6-7-8-9
3-4-5-6-7-8-9-10
⋮
4字突发
（BL [2：0 ] =
0b001)
0-1-2-3
1-2-3-0
2-3-0-1
3-0-1-2
8字突发
（BL [2：0 ] = 0b010 ）
0-1-2-3-4-5-6-7
1-2-3-4-5-6-7-0
2-3-4-5-6-7-0-1
3-4-5-6-7-0-1-2
4-5-6-7-0-1-2-3
5-6-7-0-1-2-3-4
6-7-0-1-2-3-4-5
7-0-1-2-3-4-5-6
⋮
16字突发
（BL [2：0 ] = 0b011 ）
0-1-2-3-4…14-15
1-2-3-4-5…15-0
2-3-4-5-6…15-0-1
3-4-5-6-7…15-0-1-2
4-5-6-7-8…15-0-1-2-3
5-6-7-8-9…15-0-1-2-3-4
6-7-8-9-10…15-0-1-2-3-4-5
7-8-9-10…15-0-1-2-3-4-5-6
⋮
14-15-0-1-2…12-13
15-0-1-2-3…13-14
⋮
0-1-2-3-4…14-15
1-2-3-4-5…15-16
2-3-4-5-6…16-17
3-4-5-6-7…17-18
可连拍
（BL [2：0 ] = 0b111 ）
0-1-2-3-4-5-6-…
1-2-3-4-5-6-7-…
2-3-4-5-6-7-8-…
3-4-5-6-7-8-9-…
4-5-6-7-8-9-10…
5-6-7-8-9-10-11…
6-7-8-9-10-11-12-…
7-8-9-10-11-12-13…
⋮
14-15-16-17-18-19-20-…
15-16-17-18-19-20-21-…
⋮
0-1-2-3-4-5-6-…
1-2-3-4-5-6-7-…
2-3-4-5-6-7-8-…
3-4-5-6-7-8-9-…
PDF ： 09005aef84566799
p30_65nm_MLC_256Mb - 512mb.pdf - 版本C 12/13 EN
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