MT8952B 参数 Datasheet PDF下载

型号：	MT8952B
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内容描述：	ISO- CMOS ST- BUS⑩家庭HDLC协议控制器 [ISO-CMOS ST-BUS⑩ FAMILY HDLC Protocol Controller]
分类和应用：	控制器
文件页数/大小：	22 页 / 370 K
品牌：	MITEL [ MITEL NETWORKS CORPORATION ]

ISO- CMOS

序位传输/接收

最不显着的位（LSB ）对应于D0

在数据总线上发送音响首先在串行

输出（ CDSTo ）。在接收侧，所述网络连接第一个位

在串行输入端接收（ CDSTi ）被认为是

LSB的和放置在数据总线的D0中。

RX FIFO

状态位

RX FIFO空

MT8952B

状态

小于或等于14个字节

RX FIFO满

大于或等于15个字节

表4.接收FIFO状态

有在HDLC的协议的多个寄存器

访问相关联的微控制器

通过数据总线处理器。这些地址

寄存器示于表1和它们的功能赋予

细节在下面给出。

FIFO状态寄存器（读）：

该寄存器（图4 ）指示的状态

发送和接收FIFO和接收的字节为

如下所述。

低

更新。当内部4.096 MHz的定时模式，

在MT8952B必须接受四个下降沿

C4I系统时钟前的Rx FIFO的状态位将是

更新（请参见接收操作的章节 -

正常的数据包）。

TX FIFO状态：

这两个位（ D3和D2 ）表示

发送FIFO的状态示于表5 。

TX FIFO

状态位

TX FIFO满

大于或等于5个字节

TX FIFO空

状态

接收字节

状态

RX FIFO

TX FIFO

低

状态

图4 - FIFO状态寄存器

接收字节状态：

这两个位（ D7和D6 ）表示

接收到的字节就绪的状态，从读

接收FIFO 。的状态进行编码，如图

表3中。

接收字节

状态位

包字节

科幻RST字节

最后字节（好FCS）

小于或等于4个字节

表5.发送FIFO状态

状态

TX FIFO的状态位在同一个更新

方式，向Rx FIFO的比特，所不同的是在外部

定时模式，并在内部2.048 Mbps的时间

模式中，Tx FIFO状态位2更新后

在CKI或C2I信号的下降沿（看

节发射操作 - 普通数据包）。

接收数据寄存器（读）：

读取接收数据寄存器（图5 ），可以让

从网络连接第一个字节的数据总线上接收FIFO 。

接收的串行输入数据的网络连接第一个位

（ CDSTi ）被认为是LSB的和可

在数据总线的D0中。

RD7

最后字节（ FCS错误）

表3.接收的字节状态

Rx FIFO的状态：

这些位（ D5和D4 ）表示

状态的接收FIFO中所给出的表4中的Rx

FIFO状态位未之后立即更新

在Rx FIFO中的（接入从一个读

微处理器端口，或者从串行端口写操作），

以避免不可恢复的错误的存在

条件。

当外部定时模式下， MT8952B绝

接收的时钟信号的两个下降沿处

之前，长江基建输入Rx FIFO的状态位会

更新。当内部2.048 MHz的定时模式，

在MT8952B必须接受两个下降沿

前Rx FIFO的状态位C2I时钟会

RD6

RD5

RD4

RD3

RD2

RD1

RD0

图5 - 接收数据寄存器

发送数据寄存器（写）：

写发送数据寄存器（图6）放

目前的数据在数据总线上发送FIFO 。

的LSB （ D0 ）传输网络RST 。

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