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    PL611S-02 参数 Datasheet PDF下载

    PL611S-02图片预览
    型号： PL611S-02
    PDF下载： 下载PDF文件 查看货源
    内容描述： 1.8V - 3.3V PicoPLLTM ，世界上最小的可编程时钟 [1.8V-3.3V PicoPLLTM, World’s Smallest Programmable Clock]
    分类和应用： 时钟
    文件页数/大小： 8 页 / 215 K
    品牌： PLL [ PHASELINK CORPORATION ]
     浏览型号PL611S-02的Datasheet PDF文件第1页浏览型号PL611S-02的Datasheet PDF文件第2页浏览型号PL611S-02的Datasheet PDF文件第3页浏览型号PL611S-02的Datasheet PDF文件第4页浏览型号PL611S-02的Datasheet PDF文件第5页浏览型号PL611S-02的Datasheet PDF文件第7页浏览型号PL611S-02的Datasheet PDF文件第8页  
    （初步）
    PL611s-02
    1.8V - 3.3V PicoPLL
    TM
    ，世界上最小的可编程时钟
    布局建议
    下面的指南，以帮助您与性能优化的PCB设计：
    - 保持所有的PCB走线到PL611s -02短
    如可能的话，以及保持所有其他痕迹如
    远离它成为可能。
    - 将一个0.01 F〜 0.1μF的去耦电容
    VDD和GND之间，在组件端
    PCB板，接近VDD引脚。它不是
    建议将在此组件
    背后的PCB板。经历过孔将减少
    的信号完整性，从而导致额外的抖动和
    相位噪声。
    - 强烈建议保持VDD和
    接地迹线尽可能短。
    - 当连接长的痕迹（ > 1英寸）到一个CMOS
    输出，设计的痕迹作为一个重要的是
    传输线或“带状线” ，以避免反射或
    响。在这种情况下， CMOS输出需要被
    匹配的走线阻抗。通常是“带状线”
    设计用于50阻抗和CMOS输出
    通常具有低于50的阻抗，以便
    匹配可以通过添加在电阻器来实现
    系列的CMOS输出引脚的'带状'
    迹。
    - 请联系PhaseLink了解更多信息
    如何设计输出驱动长走线或
    该Gerber文件的PL611s -02评估板
    如图所示。
    DFN -6L评估板
    47745弗里蒙特大道，弗里蒙特，加利福尼亚州94538电话：（ 510 ） 492-0990传真：（ 510 ） 492-0991
    www.phaselink.com
    转06年12月12日第6页

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