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PL613-05-XXXSIR 参数 Datasheet PDF下载

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型号: PL613-05-XXXSIR
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内容描述: 1.8V - 3.3V PicoTreoTM , 3 -PLL , 200MHz的,5个输出时钟IC [1.8V-3.3V PicoTreoTM, 3-PLL, 200MHz, 5 Output Clock IC]
分类和应用: 时钟
文件页数/大小: 9 页 / 455 K
品牌: PLL [ PHASELINK CORPORATION ]
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(初步)
1.8V - 3.3V PicoTreo
TM
, 3 -PLL , 200MHz的,5个输出时钟IC
上的即时配置交换( CSEL )
该PL613-05可以被编程为允许开关
2种不同的构型之间,允许
变化,输出频率和其它特征
变化。许多应用程序(即视频/音频),可以使用
同样的设计尺寸,但允许配置
切换时,粘附于各种标准。 CSEL是
用于进行切换选择。该引脚
采用了60KΩ
上拉电阻
正常
的操作条件。配置的逻辑
编程部分的切换如下所示:
CSEL
0
1
程序
CON组fi guration
0
1(Default)
注:典型的启用时间为100μs
.
布局建议
下面的指南,以帮助您与性能优化的PCB设计:
信号完整性和终止
注意事项
- 保持走线短!
- 跟踪=电感。随着容性负载这个
等于响起!
- 长期跟踪=输电线路。如果没有适当的
终止这将导致反射(看起来像
振铃) 。
- 设计长走线为“带状线”或“微带”
与定义的阻抗。
- 匹配跟踪一侧,以避免反射
来回弹跳。
解耦和电源
注意事项
- 将去耦电容尽量靠近,以
VDD端子(S)以从电源限制噪声
- 多VDD引脚应单独分离
为了获得最佳性能。
- 增加了一个铁氧体磁环的串联与VDD的
帮助防止其他董事会噪音源
- 去耦电容值是频率
依赖。典型值是使用0.1μF的
使用晶振< 50MHz的和0.01μF的设计
外观设计采用晶体> 50MHz的。
47745弗里蒙特大道,弗里蒙特,加利福尼亚州94538电话:( 510 ) 492-0990传真:( 510 ) 492-0991
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