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C8051F338-GM 参数 Datasheet PDF下载

C8051F338-GM图片预览
型号: C8051F338-GM
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内容描述: 混合信号ISP功能的Flash MCU系列 [Mixed Signal ISP Flash MCU Family]
分类和应用:
文件页数/大小: 234 页 / 3348 K
品牌: SILABS [ SILICON LABORATORIES ]
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C8051F336/7/8/9
20.3 。优先权交叉开关译码器
优先级交叉开关译码器(图20.3 )分配一个优先级为每个I / O功能,开始与顶级
UART0 。当选择了一个数字资源,所述至少-显著未分配的端口引脚分配给该
资源( UART0除外,它总是在引脚4和5 ) 。如果一个端口引脚分配,交叉开关跳过
该引脚分配下一个选择的资源时。此外,交叉开关将跳过端口引脚,其
在PnSKIP寄存器相关位被置位。 PnSKIP寄存器允许软件跳过端口引脚
被用于模拟输入,特殊功能或GPIO 。
在交叉开关配置的重要注意事项:
如果一个端口引脚被一个外设,而不使用
交叉开关,其对应的PnSKIP位应设置。这适用于P0.0 ,如果VREF时, P0.3和/或
P0.2如果外部振荡器电路被使能),P0.6(如果ADC或IDAC被配置为使用外部
转换开始信号( CNVSTR )和任何被选择的ADC或比较器输入。交叉开关跳过
选择的管脚,就好像已经分配,并且移动到下一个未分配的引脚。如图20.3所示
交叉开关译码器优先权没有引脚被跳过( P0SKIP , P1SKIP = 0×00 ) ;如图20.4所示
交叉开关译码器的优先级与XTAL1 ( P0.2 )和XTAL2 ( P0.3 )引脚被跳过( P0SKIP = 0x0C的) 。
P0
SF信号
引脚I / O
TX0
RX0
SCK
MISO
MOSI
NSS
1
SDA
SCL
CP0
CP0A
系统时钟
CEX0
CEX1
CEX2
ECI
T0
T1
0
0
0
0
0
0
0
0
0
0
0
0
VREF IDA
0
1
x1
2
x2
3
4
5
CNVSTR
6
7
0
1
2
3
P1
4
5
6
7
0
1
2
P2
2
2
3
2
4
2
0
0
0
0
0
0
0
0
P0SKIP [0:7 ]
端口引脚可能提供给外设
SF信号
特殊功能信号不被交叉开关分配。
如果启用了这些信号,交叉开关必须被
手动配置,以跳过它们对应的端口引脚。
P1SKIP [0:7 ]
P2SKIP [0:3 ]
注意事项:
1. NSS只固定在4线SPI模式
2.销仅在QFN24封装P2.1 - P2.4
图20.3 。交叉开关优先权译码与无针跳过
修订版0.2
引脚不可用于横梁的外围设备。
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