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WEDPN16M64V-133B2M 参数 Datasheet PDF下载

WEDPN16M64V-133B2M图片预览
型号: WEDPN16M64V-133B2M
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内容描述: 16Mx64同步DRAM [16Mx64 Synchronous DRAM]
分类和应用: 存储内存集成电路动态存储器
文件页数/大小: 15 页 / 572 K
品牌: WEDC [ WHITE ELECTRONIC DESIGNS CORPORATION ]
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怀特电子设计
图3 - 模式寄存器定义
BURST
A
12
A
11
A
10
A
9
A
8
A
7
A
6
A
5
A
4
A
3
A
2
A
1
A
0
地址总线
WEDPN16M64V-XB2X
表1 - 爆定义
起始列
地址
A0
0
1
A0
0
1
0
1
A0
0
1
0
1
0
1
0
1
访问顺序的内爆
类型=顺序
0-1
1-0
0-1-2-3
1-2-3-0
2-3-0-1
3-0-1-2
0-1-2-3-4-5-6-7
1-2-3-4-5-6-7-0
2-3-4-5-6-7-0-1
3-4-5-6-7-0-1-2
4-5-6-7-0-1-2-3
5-6-7-0-1-2-3-4
6-7-0-1-2-3-4-5
7-0-1-2-3-4-5-6
CN ,CN + 1 ,道道通+ 2
道道通+ 3 ,道道通+ 4 ...
... CN - 1 ,
道道通...
类型=交错
0-1
1-0
0-1-2-3
1-0-3-2
2-3-0-1
3-2-1-0
0-1-2-3-4-5-6-7
1-0-3-2-5-4-7-6
2-3-0-1-6-7-4-5
3-2-1-0-7-6-5-4
4-5-6-7-0-1-2-3
5-4-7-6-1-0-3-2
6-7-4-5-2-3-0-1
7-6-5-4-3-2-1-0
不支持
2
12 11 10 9 8
保留*
7
6 5
4 3
BT
2 1
0
模式寄存器( MX)
世运模式
CAS延迟
突发长度
*如果编程
M12, M11, M10 = 0, 0, 0
为确保兼容性
未来的设备。
4
突发长度
M2 M1 M0
0
0
0
0
1
1
1
1
0
0
1
1
0
0
1
1
0
1
0
1
0
1
0
1
M3 = 0
1
2
4
8
版权所有
版权所有
版权所有
整页
M3 = 1
1
2
4
8
版权所有
版权所有
版权所有
版权所有
8
M3
0
1
突发类型
顺序
交错
M6 M5 M4
0
0
0
0
1
1
1
1
0
0
1
1
0
0
1
1
0
1
0
1
0
1
0
1
CAS延迟
版权所有
版权所有
2
3
版权所有
版权所有
版权所有
版权所有
页面
(y)
A1
0
0
1
1
A2
A1
0
0
0
0
0
1
0
1
1
0
1
0
1
1
1
1
N = A0-9 / 8/7
(位置0 -Y )
M8
0
-
M7
0
-
M6-M0
定义
-
经营模式
标准工作
所有其他国家保留
M9
0
1
写突发模式
编程的突发长度
访问单一位置
注意事项:
1.对于整版访问:Y = 512 。
2.两个突发长度, A1-8选择块的两突发; A0选择起点
块内的列。
3.四的突发长度, A2-8选择块的四连拍; A0-1选择出发
块内的列。
4.八的突发长度, A3-8选择块的八个突发; A0-2选择
起始块内列。
5.对于全页突发,全行被选中, A0-8选择起始列。
6.每当给定序列内到达该块的边界之上,所述
以下访问块内包装。
7.一个的脉冲串长度, A0-8选择唯一的列将被访问,并且模式
寄存器位M3被忽略。
2005年1月
第1版
5
怀特电子设计公司• ( 602 ) 437-1520 •www.wedc.com